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參數(shù)資料
| 型號： | MK2069-03GITR |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘產(chǎn)生/分配 |
| 英文描述： | 160 MHz, OTHER CLOCK GENERATOR, PDSO56 |
| 封裝： | 6.10 MM, 0.50 MM PITCH, TSSOP-56 |
| 文件頁數(shù)： | 19/20頁 |
| 文件大小： | 204K |
| 代理商： | MK2069-03GITR |
MK2069-03
VCXO-BASED CLOCK TRANSLATOR WITH HIGH MULTIPLICATION
VCXO AND SYNTHESIZER
IDT / ICS VCXO-BASED CLOCK TRANSLATOR WITH HIGH MULTIPLICATION 8
MK2069-03
REV J 030906
VCXO Gain (KO) vs. XTAL Frequency
Example Loop Filter Component Value
Notes:
1) This filter configuration assures a passband ripple compliant with Bellcore GR-1244-CORE to satisfy wander
transfer requirements (<0.2 dB ripple is required) of a network node. It can be used following a system synchronizer
such as the MT9045 to provide clock jitter attenuation while maintaining Stratum 3 compliance. A 155.52 MHz TCLK
output generated with the VCXO PLL configuration will be OC-3 and OC-12 timing jitter compliant.
2) This is a reduced cost and size variant of the above filter, due to the decreased size of CS. It is useful when
GR-1244-CORE compliance is not needed.
3) This configuration is used to generate a DS3 clock of 44.736 MHz at the TCLK output. This configuration is
GR-1244-CORE compliant when used following a system synchronizer.
10
20
15
25
3 0
2000
3000
4000
5000
6000
1000
C rys ta l Freq uency, M H z
VC
XO
G
a
in
(
K
O
),
H
z
p
e
r
V
o
lt
Phase
Detector
Frequency
Xtal
Freq
(MHz)
SV
Div
VCLK
(MHz)
FV Div x
FPV Div
RSET
RS
CS
CP
Loop
BW
(-3dB)
Loop
Damp.
Passband
Peaking
Note
8 kHz
19.44
1
19.44
2430
1 M
Ω 560 kΩ 1 μF 4.7 nF 22 Hz
4.0
0.15dB at 1Hz
1
8 kHz
19.44
1
19.44
2430
1 M
Ω 560 kΩ 0.1 μF 4.7 nF 27 Hz
1.4
1.2dB at 6Hz
2
8 kHz
22.368
1
22.368
2796
1 M
Ω 680 kΩ 1 μF 4.7 nF 20 Hz
4.5
0.12dB at 1Hz
3
相關(guān)PDF資料 |
PDF描述 |
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