參數(shù)資料
| 型號： | MIC2555-0BML TR |
| 廠商： | Micrel Inc |
| 文件頁數(shù)： | 20/29頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX UTG USB BUS UNIV 24MLF |
| 標準包裝： | 1,000 |
| 類型： | 收發(fā)器 |
| 驅動器/接收器數(shù)： | 1/0 |
| 規(guī)程： | USB 2.0 |
| 電源電壓： | 3 V ~ 4.5 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-VFQFN 裸露焊盤，24-MLF? |
| 供應商設備封裝： | 24-MLF?（4x4） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | MIC2555-0BMLTR |
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Micrel, Inc.
MIC2555
December 2006
27
M9999-121406
GPIO Interrupt Mask False
Set & Clear
set – 1Ch
clr – 1Dh
Enables interrupts on transition from TRUE to FALSE
1
set = 1, Interrupt on T F.
1
clr = 0, no interrupt.
GPIO_0
1
rd/s/c
bit 0
GPIO_1
1
rd/s/c
bit 1
GPIO_2
1
rd/s/c
bit 2
1
rd/s/c
bit 3
1
rd/s/c
bit 4
1
rd/s/c
bit 5
1
rd/s/c
bit 6
1
rd/s/c
bit 7
GPIO Interrupt Mask True
Set & Clear
set – 1Eh
clr – 1Fh
Enables interrupts on transition from FALSE to
TRUE.
1
set = 1, Interrupt on F T.
1
clr = 0, no interrupt.
GPIO_0
1
rd/s/c
bit 0
GPIO_1
1
rd/s/c
bit 1
GPIO_2
1
rd/s/c
bit 2
1
rd/s/c
bit 3
1
rd/s/c
bit 4
1
rd/s/c
bit 5
1
rd/s/c
bit 6
1
rd/s/c
bit 7
Note:
Access type “rd/s/c” denotes a field that can be read, set to 1 or cleared to 0. The register can be read from either of
the Addresses indicated. When writing to the “set” Address, any 1’s that are written cause the associated bit to be set.
When writing to the “clr” (Clear) Address, any 1s that are written cause the associated bit to be cleared.
Example Serial Controller Register Settings
Example
Location
Condition
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Target register
Initial state
0
1
0
1
0
‘Set’ register
Data loaded into ‘set’
register
1
0
1
0
Target register
Resulting state
1
0
1
0
1
0
‘Clear’ register
Data
loaded
into
‘Clear’ register
1
0
1
0
Target register
Resulting state
0
1
0
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