參數(shù)資料
型號(hào)： MH64D72KLH-75
廠商： Mitsubishi Electric Corporation
英文描述： 4,831,838,208-BIT (67,108,864-WORD BY 72-BIT) Double Data Rate Synchronous DRAM Module
中文描述： 4831838208位（67108864 - Word的72位），雙數(shù)據(jù)速率同步DRAM模塊
文件頁(yè)數(shù)： 28/38頁(yè)
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代理商： MH64D72KLH-75
MITSUBISHI LSIs
MITSUBISHI ELECTRIC
MH64D72KLG-75,-10
4,831,838,208-BIT (67,108,864-WORD BY 72-BIT) Double Data Rate Synchronous DRAM Module
MIT-DS-0389-1.1
20.Nov.2000
Preliminary Spec.
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28
[Read Interrupted by Burst Stop]
Burst read operation can be interrupted by a burst stop command(TERM). READ to TERM
interval is minimum 1 CLK. A TERM command to output disable latency is equivalent to the /CAS
Latency. As a result, READ to TERM interval determines valid data length to be output. The figure
below shows examples of BL=8.
Read Interrupted by TERM (BL=8)
CL=2.5
Command
DQS
Command
DQ
Command
DQ
Q0
Q1
Q2
Q3
Q0
Q1
/CLK
CLK
DQ
Q0
Q1
Q2
Q3
Q4
Q5
TERM
READ
READ
TERM
READ
TERM
DQS
DQS
CL=2.0
Command
DQS
Command
DQ
Command
DQ
Q0
Q1
Q2
Q3
Q0
Q1
DQ
Q0
Q1
Q2
Q3
Q4
Q5
TERM
READ
READ
TERM
READ
TERM
DQS
DQS
Module input and output timing.
Discrete
CL=3.5
Module
Discrete
CL=3.0
Module
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PDF描述
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