參數(shù)資料
型號(hào)： MCS12KG256CPVE
廠商： Freescale Semiconductor
文件頁數(shù)： 236/654頁
文件大?。?/td> 0K
描述： IC MCU 256K FLASH 25MHZ 112-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： HCS12
核心處理器： HCS12
芯體尺寸： 16-位
速度： 25MHz
連通性： CAN，EBI/EMI，I²C，SCI，SPI
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 91
程序存儲(chǔ)器容量： 256KB（256K x 8）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 4K x 8
RAM 容量： 12K x 8
電壓 - 電源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 112-LQFP
包裝： 托盤
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Chapter 9 Inter-Integrated Circuit (IICV2) Block Description
MC9S12KT256 Data Sheet, Rev. 1.16
310
Freescale Semiconductor
9.4.1.8
Handshaking
The clock synchronization mechanism can be used as a handshake in data transfer. Slave devices may hold
the SCL low after completion of one byte transfer (9 bits). In such case, it halts the bus clock and forces
the master clock into wait states until the slave releases the SCL line.
9.4.1.9
Clock Stretching
The clock synchronization mechanism can be used by slaves to slow down the bit rate of a transfer. After
the master has driven SCL low the slave can drive SCL low for the required period and then release it.If
the slave SCL low period is greater than the master SCL low period then the resulting SCL bus signal low
period is stretched.
9.4.2
Operation in Run Mode
This is the basic mode of operation.
9.4.3
Operation in Wait Mode
IIC operation in wait mode can be congured. Depending on the state of internal bits, the IIC can operate
normally when the CPU is in wait mode or the IIC clock generation can be turned off and the IIC module
enters a power conservation state during wait mode. In the later case, any transmission or reception in
progress stops at wait mode entry.
9.4.4
Operation in Stop Mode
The IIC is inactive in stop mode for reduced power consumption. The STOP instruction does not affect IIC
register states.
9.5
Resets
The reset state of each individual bit is listed in Section 9.3, “Memory Map and Register Denition,” which
details the registers and their bit-elds.
9.6
Interrupts
IICV2 uses only one interrupt vector.
Table 9-8. Interrupt Summary
Internally there are three types of interrupts in IIC. The interrupt service routine can determine the interrupt
type by reading the status register.
Interrupt
Offset
Vector
Priority
Source
Description
IIC
Interrupt
—
IBAL, TCF, IAAS
bits in IBSR
register
When either of IBAL, TCF or IAAS bits is set
may cause an interrupt based on arbitration
lost, transfer complete or address detect
conditions
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PDF描述
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MCS16-10B 制造商:Pelco 功能描述:MSTR CAM PWR SUP 10AMP 16OUT/B
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