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參數(shù)資料
| 型號(hào)： | MCP4132-503E/MF |
| 廠商： | Microchip Technology |
| 文件頁(yè)數(shù)： | 51/59頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC RHEO DGTL SNGL 50K SPI 8DFN |
| 標(biāo)準(zhǔn)包裝： | 120 |
| 接片： | 129 |
| 電阻（歐姆）： | 50k |
| 電路數(shù)： | 1 |
| 溫度系數(shù)： | 標(biāo)準(zhǔn)值 150 ppm/°C |
| 存儲(chǔ)器類型： | 易失 |
| 接口： | 4 線 SPI（芯片選擇） |
| 電源電壓： | 1.8 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-VDFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 8-DFN-EP（3x3） |
| 包裝： | 管件 |
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Micrel, Inc.
KSZ8051MNL/RNL
July 2010
55
M9999-070910-1.0
Reset Circuit
The following reset circuit is recommended for powering up the KSZ8051MNL/RNL if reset is triggered by the power
supply.
Figure 19. Recommended Reset Circuit
The following reset circuit is recommended for applications where reset is driven by another device (e.g., CPU or FPGA).
At power-on-reset, R, C and D1 provide the necessary ramp rise time to reset the KSZ8051MNL/RNL device. The
RST_OUT_n from CPU/FPGA provides the warm reset after power up.
Figure 20. Recommended Reset Circuit for interfacing with CPU/FPGA Reset Output.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-BNF-MV | CONVERTER MOD DC/DC 72V 150W |
| VI-B3K-MY-F2 | CONVERTER MOD DC/DC 40V 50W |
| VI-BND-MW-B1 | CONVERTER MOD DC/DC 85V 100W |
| MCP4132-104E/MF | IC RHEO DGTL SNGL 100K SPI 8DFN |
| MCP4132-103E/MS | IC RHEO DGTL SNGL 10K SPI 8MSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCP4132-503I/MF | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4132-503I/ML | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4132-503I/MS | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4132-503I/P | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4132-503I/SL | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
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