參數(shù)資料
型號(hào)： MCIMX515DJZK8C
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 188/202頁(yè)
文件大?。?/td> 0K
描述： IC MPU I.MX51 527MAPBGA
標(biāo)準(zhǔn)包裝： 160
系列： i.MX51
核心處理器： ARM? Cortex?-A8
芯體尺寸： 32-位
速度： 800MHz
連通性： 1 線，EBI/EMI，以太網(wǎng)，I²C，IrDA，MMC，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲(chǔ)器類型： ROMless
RAM 容量： 128K x 8
電壓 - 電源 (Vcc/Vdd)： 0.8 V ~ 1.15 V
振蕩器型： 外部
工作溫度： -20°C ~ 85°C
封裝/外殼： 527-TFBGA
包裝： 托盤
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i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 6
86
Freescale Semiconductor
Electrical Characteristics
4.7.8
Image Processing Unit (IPU) Module Parameters
The purpose of the IPU is to provide comprehensive support for the flow of data from an image sensor
and/or to a display device. This support covers all aspects of these activities:
Connectivity to relevant devices—cameras, displays, graphics accelerators, and TV encoders.
Related image processing and manipulation: display processing, image conversions, and other
related functions.
Synchronization and control capabilities such as avoidance of tearing artifacts.
4.7.8.1
Sensor Interface Timings
There are three camera timing modes supported by the IPU.
4.7.8.1.1
BT.656 and BT.1120 Video Mode
Smart camera sensors, which include imaging processing, usually support video mode transfer. They use
an embedded timing syntax to replace the SENSB_VSYNC and SENSB_HSYNC signals. The timing
syntax is defined by the BT.656/BT.1120 standards.
This operation mode follows the recommendations of ITU BT.656/ ITU BT.1120 specifications. The only
control signal used is SENSB_PIX_CLK. Start-of-frame and active-line signals are embedded in the data
stream. An active line starts with a SAV code and ends with a EAV code. In some cases, digital blanking
is inserted in between EAV and SAV code. The CSI decodes and filters out the timing-coding from the data
stream, thus recovering SENSB_VSYNC and SENSB_HSYNC signals for internal use. On BT.656 one
component per cycle is received over the SENSB_DATA bus. On BT.1120 two components per cycle are
received over the SENSB_DATA bus.
4.7.8.1.2
Gated Clock Mode
The SENSB_VSYNC, SENSB_HSYNC, and SENSB_PIX_CLK signals are used in this mode. See
Figure 50. Gated Clock Mode Timing Diagram
SENSB_VSYNC
SENSB_HSYNC
SENSB_PIX_CLK
SENSB_DATA[19:0]
invalid
1st byte
n+1th frame
invalid
1st byte
nth frame
Active Line
Start of Frame
相關(guān)PDF資料
PDF描述
MCIMX537CVV8B MULTIMEDIA PROC 529-TEPBGA
MCP2003-E/MD TXRX LIN BUS BIDIRECT 8DFN
MCP201T-I/SN IC LIN TXRX ON-BOARD VREG 8SOIC
MCP2021A-330E/MD IC TXRX LIN 3.3V LDO 8-DFN
MCP2022PT-500E/ST IC TXRX LIN ON-BOARD VREG 14TSSO
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCIMX515DVK8B 制造商:Freescale Semiconductor 功能描述:
MCIMX515DVK8C 功能描述:處理器 - 專門應(yīng)用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
MCIMX515DVM8B 制造商:Freescale Semiconductor 功能描述:APPLICATIONS PROCESSOR TRAY - Bulk
MCIMX516AJM6C 功能描述:處理器 - 專門應(yīng)用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
MCIMX516AJM6CR2 制造商:Freescale Semiconductor 功能描述:ELVIS 3.0 AUTO NO MV - Tape and Reel
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