參數(shù)資料
型號(hào)： MCIMX31LDVMN5DR2
廠商： Freescale Semiconductor
文件頁數(shù)： 109/118頁
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描述： IC MPU I.MX31L CONSUMR 473MAPBGA
標(biāo)準(zhǔn)包裝： 750
系列： i.MX31
核心處理器： ARM11
芯體尺寸： 32-位
速度： 532MHz
連通性： 1 線，ATA，EBI/EMI，F(xiàn)IR，I²C，MMC/SD，PCMCIA，SIM，SPI，SSI，UART/USART，USB，USB OTG
外圍設(shè)備： DMA，LCD，POR，PWM，WDT
程序存儲(chǔ)器類型： ROMless
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 1.22 V ~ 3.3 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 473-LFBGA
包裝： 帶卷 (TR)
MCIMX31/MCIMX31L Technical Data, Rev. 4.3
90
Freescale Semiconductor
Electrical Characteristics
Figure 73. Internal-Reset Card Reset Sequence
4.3.20.2.2
Cards with Active Low Reset
The sequence of reset for this kind of card is as follows (see Figure 74):
1. After powerup, the clock signal is enabled on CLK (time T0)
2. After 200 clock cycles, RX must be high.
3. RST must remain Low for at least 40000 clock cycles after T0 (no response is to be received on
RX during those 40000 clock cycles)
4. RST is set High (time T1)
5. RST must remain High for at least 40000 clock cycles after T1 and a response must be received
on RX between 400 and 40000 clock cycles after T1.
Figure 74. Active-Low-Reset Card Reset Sequence
SVEN
CLK
RX
2
T0
1
response
2
1
< 200 clock cycles
< 40000 clock cycles
400 clock cycles <
SVEN
CLK
RX
2
T0
1
response
RST
T1
1
2
< 200 clock cycles
< 40000 clock cycles
400 clock cycles <
3
400000 clock cycles <
相關(guān)PDF資料
PDF描述
302S43W151KV4E CAP CER 150PF 3KV 10% X7R 1812
JBXER0G05FSSDSR CONN RCPT 5POS FRONT PNL MNT SLD
MCIMX31LDVKN5DR2 IC MPU I/MX31L CONSUMR 457MAPBGA
UTS6JC12E10S CONN PLUG CABLE 10POS W/SCKT
MCIMX31LCVKN5DR2 IC MPU I.MX31L CONSMR 457MAPBGA
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參數(shù)描述
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MCIMX31LPDK 功能描述:開發(fā)板和工具包 - ARM 3 STACK BD ASSY PLASTIC RoHS:否 制造商:Arduino 產(chǎn)品:Development Boards 工具用于評(píng)估:ATSAM3X8EA-AU 核心:ARM Cortex M3 接口類型:DAC, ICSP, JTAG, UART, USB 工作電源電壓:3.3 V
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MCIMX31LVKN5 制造商:Freescale Semiconductor 功能描述:Microcontroller
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