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參數(shù)資料
| 型號： | MCIMX258CVM4 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA400 |
| 封裝： | 17 X 17 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-400 |
| 文件頁數(shù)： | 64/154頁 |
| 文件大?。?/td> | 1498K |
| 代理商： | MCIMX258CVM4 |
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i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 8
Freescale Semiconductor
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Figure 2 shows the power-up sequence diagram. After POR_B is asserted, Core VDD and NVDDx can be
powered up. After Core VDD and NVDDx are stable, the analog supplies can be powered up.
Figure 2. Power-Up Sequence Diagram
3.2.2
Power-Down Sequence
There are no special requirements for the power-down sequence. All power supplies can be shut down at
the same time.
3.2.3
SRTC DryIce Power-Up/Down Sequence
In order to guarantee DryIce power-loss protection, which includes that SRTC time is kept during
power-down; in addition to having the proper capacitor placed on the NVCC_DRYICE output pin, users
must follow the specific power-up/down sequence.
For users who want to utilize the DryIce power-loss protection feature, the following power-up sequence
is recommended:
1. Assert Power on reset (POR).
2. Turn on NVCC_CRM.
3. At any time from step 2 and to step 4, turn on other digital I/O power suppliers NVCCx.
4. Turn on digital logic domain QVDD no less than 1 ms and no greater than 32 ms after
NVCC_CRM reaches 90 % of 3.3 V. Step 2 and step 4 order are critical for proper power-loss
protection.
NOTE
This is to guarantee that POR is stable already at NVCC_CRM/QVDD
power domain interface before QVDD is on, and POR instantly propagates
to QVDD domain after QVDD is on.
Analog Supplies
POR_B
QVDD and NVDD
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