參數(shù)資料
型號： MCIMX255AJM4
廠商： Freescale Semiconductor
文件頁數(shù)： 117/140頁
文件大小： 0K
描述： MPU IMX25 AUTO 400-MAPBGA
特色產(chǎn)品： MCIMX25 Applications Processors
標(biāo)準(zhǔn)包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲器類型： 外部程序存儲器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Automotive Products, Rev. 10
78
Freescale Semiconductor
NOTE
All configuration parameters (CSA, CSN, EBWA, EBWN, LBA, LBN,
LAH, OEN, OEA, EBRA, and EBRN) are in cycle units.
1 For the value of parameters WE4–WE21, see column BCD = 0 in Table 56.
2 CS Assertion. This bit field determines when the CS signal is asserted during read/write cycles.
3 CS Negation. This bit field determines when the CS signal is negated during read/write cycles.
4 BE Assertion. This bit field determines when the BE signal is asserted during read cycles.
5 BE Negation. This bit field determines when the BE signal is negated during read cycles.
6 Output maximum delay from internal driving ADDR/control FFs to chip outputs.
7 Output maximum delay from CS[x] internal driving FFs to CS[x] out.
8 DATA maximum delay from chip input data to its internal FF.
9 DTACK maximum delay from chip dtack input to its internal FF.
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PDF描述
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參數(shù)描述
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