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參數(shù)資料
| 型號： | MCHC908JW32FC |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 228/232頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 32K FLASH 8MHZ 48-QFN |
| 標準包裝： | 260 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 連通性： | SPI，USB |
| 外圍設(shè)備： | LED，LVD，POR，PWM |
| 輸入/輸出數(shù)： | 29 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 726 (CN2011-ZH PDF) |
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Functional Description
MC68HC908JW32 Data Sheet, Rev. 6
Freescale Semiconductor
95
7.3.1 Entering Monitor Mode
Table 7-1 shows the pin conditions for entering monitor mode. As specified in the table, monitor mode
may be entered after a POR and will allow communication at 9600 baud provided one of the following
sets of conditions is met:
1.
IRQ = VTST (PLL off):
–
The external clock is 4.9152 MHz with PTC1 low
2.
IRQ = VTST (PLL off):
–
The external clock is 9.8304 MHz with PTC1 high
If VTST is applied to IRQ and PTC1 is low upon monitor mode entry (above condition set 1), the bus
frequency is a divide-by-two of the input clock. If PTC1 is high with VTST applied to IRQ upon monitor
mode entry, the bus frequency will be a divide-by-four of the input clock. Holding the PTC1 pin low when
entering monitor mode causes a bypass of a divide-by-two stage at the oscillator only if VTST is applied
to IRQ. In this event, the CGMOUT frequency is equal to the CGMXCLK frequency, and the OSC1 input
directly generates internal bus clocks. In this case, the OSC1 signal must have a 50% duty cycle at
maximum bus frequency.
The COP module is disabled in monitor mode as long as VTST is applied to either IRQ or RST.
This condition states that as long as VTST is maintained on the IRQ pin after entering monitor mode, or if
VTST is applied to RST after the initial reset to get into monitor mode (when VTST was applied to IRQ),
then the COP will be disabled. In the latter situation, after VTST is applied to the RST pin, VTST can be
removed from the IRQ pin in the interest of freeing the IRQ for normal functionality in monitor mode.
Table 7-1. Monitor Mode Signal Requirements and Options
IRQ
RST
PTA2
PTA1
PTA0
PTC1
External
Clock(1)
1. External clock is derived by a 4.9152/9.8304 MHz off-chip oscillator
Bus
Freq.
PLL
COP
Baud
Rate
Comment
X
GND
X
0
X
Disabled
0
No operation until
reset goes high
VTST
(2)
2. Monitor mode entry by IRQ = VTST, a 4.9152/9.8304 MHz off-chip oscillator must be used. The MCU internal crystal oscil-
lator circuit is bypassed.
VDD
or
VTST
0
110
4.9152
MHz
2.4576
MHz
OFF
Disabled
9600
PTA1 and PTA2
voltages only
required if
IRQ = VTST;
PTC1 determines
frequency divider
VTST
(2)
VDD
or
VTST
0
111
9.8304
MHz
2.4576
MHz
OFF
Disabled
9600
PTA1 and PTA2
voltages only
required if
IRQ = VTST;
PTC1 determines
frequency divider
VDD
or
GND
VDD
or
VTST
X
—
OFF
Enabled
—
Enters user mode
相關(guān)PDF資料 |
PDF描述 |
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