參數(shù)資料
型號： MCH908JW32FC
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, QCC48
封裝： QFN-48
文件頁數(shù)： 117/228頁
文件大?。?/td> 1433K
代理商： MCH908JW32FC
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MC68HC908JW32 Data Sheet, Rev. 3
Freescale Semiconductor
203
Chapter 17
Low-Voltage Inhibit (LVI)
17.1 Introduction
This section describes the low-voltage inhibit (LVI) module. The LVI module monitors the voltage on the
VDD pin, and can force a reset when VDD voltage falls below VTRIPF1.
17.2 Features
Features of the LVI module include:
Independent voltage monitoring circuits for VDD
Independent LVI circuit disable for VDD
Programmable LVI reset
Programmable stop mode operation
17.3 Functional Description
Figure 17-2 shows the structure of the LVI module. The LVI is enabled out of reset. The LVI module
contains independent bandgap reference circuit and comparator for monitoring the VDD voltage. An LVI
reset performs a MCU internal reset and drives the RST pin low to provide low-voltage protection to
external peripheral devices.
LVISTOP, LVIPWRD, LVIRSTD are in the CONFIG1 register. See Chapter 3 Configuration Registers
(CONFIG) for details of the LVI configuration bits. Once an LVI reset occurs, the MCU remains in reset
until VDD rises above VTRIPR1 which causes the MCU to exit reset. The output of the comparator controls
the state of the LVIOUT flag in the LVI status register (LVISR).
An LVI reset also drives the RST pin low to provide low-voltage protection to external peripheral devices.
Addr.
Register Name
Bit 7
654321
Bit 0
$FE0F
LVI Status Register
(LVISR)
Read:
LVIOUT
0000000
Write:
Reset:
00000000
= Unimplemented
Figure 17-1. LVI I/O Register Summary
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