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參數資料
| 型號： | MCF5474 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | MCF547x Integrated Microprocessor Electrical Characteristics |
| 中文描述： | MCF547x集成的微處理器，電氣特性 |
| 文件頁數： | 22/28頁 |
| 文件大?。?/td> | 706K |
| 代理商： | MCF5474 |
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MCF547x Integrated Microprocessor Electrical Characteristics, Rev. 2
I
2
C Input/Output Timing Specifications
Freescale Semiconductor
22
Figure 18
shows timing for the values in
Table 20
and
Table 21
.
Figure 18. I
2
C Input/Output Timings
Table 21. I
2
C Output Timing Specifications between SCL and SDA
Num
Characteristic
Min
Max
Units
I1
1
I2
1
I3
2
I4
1
I5
3
I6
1
I7
1
I8
1
NOTES:
1
Note: Output numbers depend on the value programmed into the IFDR; an IFDR programmed
with the maximum frequency (IFDR = 0x20) results in minimum output timings as shown in
Table 21
. The I
2
C interface is designed to scale the actual data transition time to move it to the
middle of the SCL low period. The actual position is affected by the prescale and division values
programmed into the IFDR; however, the numbers given in
Table 21
are minimum values.
2
Because SCL and SDA are open-collector-type outputs, which the processor can only actively
drive low, the time SCL or SDA take to reach a high level depends on external signal
capacitance and pull-up resistor values.
3
Specified at a nominal 50-pF load.
Start condition hold time
6
—
Bus clocks
Clock low period
10
—
Bus clocks
SCL/SDA rise time (V
IL
= 0.5 V to V
IH
= 2.4 V)
Data hold time
—
—
μS
7
—
Bus clocks
SCL/SDA fall time (V
IH
= 2.4 V to V
IL
= 0.5 V)
Clock high time
—
3
ns
10
—
Bus clocks
Data setup time
2
—
Bus clocks
Start condition setup time (for repeated start
condition only)
20
—
Bus clocks
I9
1
Stop condition setup time
10
—
Bus clocks
SCL
I2
I6
I1
I4
I5
I7
I8
I3
I9
SDA
相關PDF資料 |
PDF描述 |
|---|---|
| MCF5475 | MCF547x Integrated Microprocessor Electrical Characteristics |
| MCF547X | MCF547x Integrated Microprocessor Electrical Characteristics |
| MC68HC711E9xx | APPENDIX A ELECTRICAL CHARACTERISTICS |
| MC68HCL05J1A | TRANSISTOR,BJT,NPN,20V V(BR)CEO,400MA I(C),TO-39 |
| MC9S12A256B | device made up of standard HCS12 blocks and the HCS12 processor core |
相關代理商/技術參數 |
參數描述 |
|---|---|
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