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參數(shù)資料
| 型號： | MCF5272VM66 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 66 MHz, RISC PROCESSOR, PBGA196 |
| 封裝： | PLASTIC, BGA-196 |
| 文件頁數(shù)： | 199/550頁 |
| 文件大?。?/td> | 5933K |
| 代理商： | MCF5272VM66 |
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12-18
MCF5272 User’s Manual
MOTOROLA
Register Description and Programming Model
10
CFG_RAM_VAL
Enable USB conguration RAM. Noties the USB module that the user has loaded the
conguration RAM. Must be set in order for the USB module to process the USB
standard device requests that access the conguration RAM. These requests are
GET
_DESCRIPTOR, SET_CONFIGURATION, and SET_INTERFACE. When this bit is set,
accesses to the conguration RAM cause an access error.
0 Conguration RAM invalid
1 Conguration RAM valid
9
CMD_ERR
Command error for device request interface. Used to indicate to the endpoint controller
that an error has been encountered during class or vendor specic device request or
SYNCH_FRAME command processing. This command bit is write only and always
returns 0 when read.
Result of Request
CMD_OVER
CMD_ERR
Processed device request successfully
1
0
Error processing the request
1
Busy processing the request
0
X
Note: CMD_OVER and CMD_ERR have to be written simultaneously. The CMD_OVER
and CMD_ERR bits control the status stage response for vendor and class specic
requests.
8
CMD_OVER
Command over for device request interface. Used to indicate to the endpoint controller
that processing of a class or vendor specic device request or SYNCH_FRAME
command has been completed by the user. This command bit is write only and always
returns 0 when read.
Note: CMD_OVER and CMD_ERR have to be written simultaneously. The CMD_OVER
and CMD_ERR bits control the status stage response for vendor and class specic
requests.
7
CRC_ERR
CRC error generation enable. This bit enables CRC error generation for debug and test
purpose. In order to use this feature, the DEBUG bit must be set. Enabling this bit causes
a CRC error on the next data packet transmitted. The CRC_ERR bit must be set again in
order to generate another CRC error. This bit only applies to IN transfers. This command
bit is write-only and always returns 0 when read.
1 CRC error generation if DEBUG = 1
0 default value
6
—
Reserved, should be cleared.
5–4
OUT_LVL
Endpoint 0 OUT FIFO level for interrupt. This eld selects the FIFO level to generate an
OUT_LVL interrupt. The OUT_LVL interrupt is generated when the FIFO lls above the
selected level.
00 FIFO 25% Full
01 FIFO 50% Full
10 FIFO 75% Full
11 FIFO 100% Full
3–2
IN_LVL
Endpoint 0 IN FIFO level for interrupt. This eld selects the FIFO level to generate an
IN_LVL interrupt. The IN_LVL interrupt is generated when the FIFO falls below the
selected level.
00 FIFO 25% Empty
01 FIFO 50% Empty
10 FIFO 75% Empty
11 FIFO 100% Empty
Table 12-12. EP0CTL Field Descriptions (Continued)
Bits
Name
Description
相關PDF資料 |
PDF描述 |
|---|---|
| MC9S12Q64MFA8 | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48 |
| M38D28G8-XXXHP | 8-BIT, FLASH, 6.25 MHz, MICROCONTROLLER, PQFP64 |
| MC68HC05C9ACB | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP42 |
| MC68HC05C9ACFB | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP44 |
| MC68HC05C9ACFN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC44 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5272VM66 K75N | 制造商:FREESCALE-SEMI 功能描述: |
| MCF5272VM66J | 功能描述:32位微控制器 - MCU V2CORE 4KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:90 MHz 程序存儲器大小:64 KB 數(shù)據(jù) RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風格:SMD/SMT |
| MCF5272VM66J | 制造商:Freescale Semiconductor 功能描述:IC 32BIT MPU 66MHZ BGA-196 |
| MCF5272VM66R2 | 功能描述:微處理器 - MPU MCF5272 V2CORE 4KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5272VM66R2 | 制造商:Freescale Semiconductor 功能描述:Microcontroler |
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