參數(shù)資料
型號(hào)： MCF5270CAB100
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 322/626頁(yè)
文件大?。?/td> 0K
描述： IC MCU 32BIT 100MHZ 160QFP
標(biāo)準(zhǔn)包裝： 24
系列： MCF527x
核心處理器： Coldfire V2
芯體尺寸： 32-位
速度： 100MHz
連通性： EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART
外圍設(shè)備： DMA，WDT
輸入/輸出數(shù)： 39
程序存儲(chǔ)器類型： ROMless
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.4 V ~ 1.6 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 160-BQFP
包裝： 托盤(pán)
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Functional Description
MCF5271 Reference Manual, Rev. 2
Freescale Semiconductor
19-45
19.3.10 Full Duplex Flow Control
Full-duplex flow control allows the user to transmit pause frames and to detect received pause
frames. Upon detection of a pause frame, MAC data frame transmission stops for a given pause
duration.
To enable pause frame detection, the FEC must operate in full-duplex mode (TCR[FDEN]
asserted) and flow control enable (RCR[FCE]) must be asserted. The FEC detects a pause frame
when the fields of the incoming frame match the pause frame specifications, as shown in the table
below. In addition, the receive status associated with the frame should indicate that the frame is
valid.
Pause frame detection is performed by the receiver and microcontroller modules. The
microcontroller runs an address recognition subroutine to detect the specified pause frame
destination address, while the receiver detects the type and opcode pause frame fields. On
detection of a pause frame, TCR[GTS] is set by the FEC internally. When transmission has paused,
the EIR[GRA] interrupt is asserted and the pause timer begins to increment. Note that the pause
timer makes use of the transmit backoff timer hardware, which is used for tracking the appropriate
collision backoff time in half-duplex mode. The pause timer increments once every slot time, until
OPD[PAUSE_DUR] slot times have expired. On OPD[PAUSE_DUR] expiration, TCR[GTS] is
deasserted allowing MAC data frame transmission to resume. Note that the receive flow control
pause (TCR[RFC_PAUSE]) status bit is set while the transmitter is paused due to reception of a
pause frame.
5d:ff:ff:ff:ff:ff
0x3a
58
7d:ff:ff:ff:ff:ff
0x3b
59
fd:ff:ff:ff:ff:ff
0x3c
60
dd:ff:ff:ff:ff:ff
0x3d
61
9d:ff:ff:ff:ff:ff
0x3e
62
bd:ff:ff:ff:ff:ff
0x3f
63
Table 19-37. PAUSE Frame Field Specification
48-bit Destination Address
0x0180_c200_0001 or Physical Address
48-bit Source Address
Any
16-bit Type
0x8808
16-bit Opcode
0x0001
16-bit PAUSE Duration
0x0000–0xFFFF
Table 19-36. Destination Address to 6-Bit Hash (Continued)
48-bit DA
6-bit Hash (in
hex)
Hash Decimal
Value
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PDF描述
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參數(shù)描述
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