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參數(shù)資料
| 型號： | MCF5206CAB25A |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 300/449頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU COLDFIRE 25MHZ 160-QFP |
| 標準包裝： | 24 |
| 系列： | MCF520x |
| 核心處理器： | Coldfire V2 |
| 芯體尺寸： | 32-位 |
| 速度： | 25MHz |
| 連通性： | I²C，UART/USART |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 8 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.75 V ~ 5.25 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 160-BQFP |
| 包裝： | 托盤 |
| 配用： | M5206EC3-ND - KIT EVAL FOR MCF5206E W/ETHERNET |
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Debug Support
MOTOROLA
MCF5206 USERS MANUAL Rev 1.0
14-5
1. The occurrence of the catastrophic fault-on-fault condition automatically halts the
processor. The halt status is posted on the PST port ($F).
2. The occurrence of a hardware breakpoint (reference subsection Section 14.3 Real-
Time Debug Support) can be configured to generate a pending halt condition in a
manner similar to the assertion of the BKPT signal. In some cases, the occurrence of
this type of breakpoint halts the processor in an imprecise manner. Once the hardware
breakpoint is asserted, the processor halts at the next sample point. See Section
14.3.2 Theory of Operation for more detail.
3. The execution of the HALT (also known as BGND on the 683xx devices) instruction
immediately suspends execution and posts the halt status ($F) on the PST outputs.
By default, this is a supervisor instruction and attempted execution while in user mode
generates a privilege-violation exception. A User Halt Enable (UHE) control bit is
provided in the Configuration/Status Register (CSR) to allow execution of HALT in
user mode.
4. The assertion of the BKPT input pin is treated as an pseudo-interrupt, i.e., the halt
condition is made pending until the processor core samples for halts/interrupts. The
processor samples for these conditions once during the execution of each instruction.
If there is a pending halt condition at the sample time, the processor suspends
execution and enters the halted state. The halt status ($F) is reflected in the PST
outputs.
The halt source is indicated in CSR[27:24]; for simultaneous halt conditions, the highest
priority source is indicated.
There are two special cases to be considered that involve the assertion of the BKPT pin.
After RSTI is negated, the processor waits for 16 clock cycles before beginning reset
exception processing. If the BKPT input pin is asserted within the first eight cycles after RSTI
is negated, the processor enters the halt state, signaling that status on the PST outputs ($F).
While in this state, all resources accessible via the Debug module can be referenced. Once
the system initialization is complete, the processor response to a BDM GO command
depends on the set of BDM commands performed while breakpointed. Specifically, if the
processors PC register was loaded, the GO command causes the processor to exit the halt
state and pass control to the instruction address contained in the PC. In this case, the
normal reset exception processing is bypassed. Conversely, if the PC register was not
loaded, the GO BDM command causes the processor to exit the halt state and continue with
reset exception processing.
ColdFire 52xx processors also handle a special case with the assertion of BKPT while the
processor is stopped by execution of the STOP instruction. For this case when the BKPT is
asserted, the processor exits the stopped mode and enters the halted state. Once halted,
the standard BDM commands may be exercised. When the processor is restarted, it
continues with the execution of the next sequential instruction, i.e., the instruction following
the STOP opcode.
The debug module Configuration/Status Register (CSR) maintains status defining the
condition that caused the CPU to halt.
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Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCF5206AB33A | IC MCU COLDFIRE 33MHZ 160-QFP |
| VE-22W-IX-F1 | CONVERTER MOD DC/DC 5.5V 75W |
| VE-22V-IX-F4 | CONVERTER MOD DC/DC 5.8V 75W |
| MC912DT128AVPVE | IC MCU 16BIT 128K FLASH 112-LQFP |
| MPC561MZP56R2 | IC MPU 32BIT 56MHZ 388-PBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5206CFT16A | 制造商:Rochester Electronics LLC 功能描述:MCF5206 V2CORE 512SRAM - Bulk |
| MCF5206CFT25A | 制造商:Rochester Electronics LLC 功能描述:MCF5206 V2CORE 512SRAM - Bulk |
| MCF5206E | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:CodeWarrior Development Studio for ColdFire㈢ Architectures |
| MCF5206EAB40 | 功能描述:微處理器 - MPU MCF5206E V2CORE 8KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5206EAB54 | 功能描述:微處理器 - MPU MCF5206E V2CORE 8KSRAM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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