參數(shù)資料
型號(hào)： MCF51JE256CLK
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50.33 MHz, MICROCONTROLLER, PQFP80
封裝： 12 X 12 MM, ROHS COMPLIANT, LQFP-80
文件頁數(shù)： 21/50頁
文件大小： 1200K
代理商： MCF51JE256CLK
Preliminary Electrical Characteristics
Freescale Semiconductor
1-2
Figure 7. Offset at Half Scale vs Temperature
Table 14. DAC 12-Bit Operating Behaviors
#
Characteristic
Symbol
Min
Max
Unit
C
Notes
1
Resolution
N
12
bit
C
2
Supply current low-power mode
IDDA_DACLP
50
100
A
C
3
Supply current high-power mode
IDDA_DACHP
120
500
(TBD)
A
C
4
Full-scale Settling time
(±0.5 LSB)
(0x080 to 0xF7F or 0xF7F to 0x080)
low-power mode
TsFSLP
—
200
(TBD)
s
C
5
Full-scale Settling time
(±0.5 LSB)
(0x080 to 0xF7F or 0xF7F to 0x080)
high-power mode
TsFSHP
—
30
s
C
6
Code-to-code Settling time
(±0.5 LSB)
(0xBF8 to 0xC08 or 0xC08 to
0xBF8)
low-power mode
TsC-CLP
—5
s
C
7
Code-to-code Settling time
(±0.5 LSB)
(0xBF8 to 0xC08 or 0xC08 to
0xBF8)
high-power mode
TsC-CHP
—1(TBD)
s
C
8
DAC output voltage range low
(high-power mode, no load, DAC
set to 0)
Vdacoutl
—
100
(TBD)
mV
C
9
DAC output voltage range high
(high-power mode, no load, DAC
set to 0x0FFF)
Vdacouth
VDAC
R-100
—mV
C
10
Integral non-linearity error
INL
—± 8
LSB
C
11
Differential non-linearity error
VDACR is > 2.4 V
DNL
—± 1
LSB
C
12
Offset error
EO
—
± 0.5
%FS
R
C
13
Gain error
EG
—
± 0.5
(TBD)
%FS
R
C
14
Power supply rejection ratio
VDD ≥ 2.4 V
PSRR
60
—
dB
C
15
Temperature drift of offset voltage
(DAC set to 0x0800)
Tco
—
2
(TBD)
mV
C
See Typical
Drift figure
that follows.
16
Offset aging coefficient
Ac
—
TBD
V/yr
C
Preliminary — Subject to Change
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PDF描述
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參數(shù)描述
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