參數(shù)資料
型號: MC9S12Q64MPB16
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP52
封裝: LQFP-52
文件頁數(shù): 644/644頁
文件大?。?/td> 3248K
代理商: MC9S12Q64MPB16
Chapter 2 Port Integration Module (PIM9C32) Block Description
Freescale Semiconductor
MC9S12Q128
99
Rev 1.10
2.3.2.5.7
Port J Interrupt Enable Register (PIEJ)
Read: Anytime.
Write: Anytime.
2.3.2.5.8
Port J Interrupt Flag Register (PIFJ)
Read: Anytime.
Write: Anytime.
Module Base + 0x002E
76543210
R
PIEJ7
PIEJ6
000000
W
Reset
0
——————
= Unimplemented or Reserved
Figure 2-38. Port J Interrupt Enable Register (PIEJ)
Table 2-32. PIEJ Field Descriptions
Field
Description
7–6
PIEJ[7:6]
Interrupt Enable Port J — This register disables or enables on a per pin basis the edge sensitive external
interrupt associated with port J.
0 Interrupt is disabled (interrupt ag masked).
1 Interrupt is enabled.
Module Base + 0x002F
76543210
R
PIFJ7
PIFJ6
000000
W
Reset
0
——————
= Unimplemented or Reserved
Figure 2-39. Port J Interrupt Flag Register (PIFJ)
Table 2-33. PIFJ Field Descriptions
Field
Description
7–6
PIFJ[7:6]
Interrupt Flags Port J — Each ag is set by an active edge on the associated input pin. This could be a rising
or a falling edge based on the state of the PPSJ register. To clear this ag, write “1” to the corresponding bit in
the PIFJ register. Writing a “0” has no effect.
0 No active edge pending.
Writing a “0” has no effect.
1 Active edge on the associated bit has occurred (an interrupt will occur if the associated enable bit is set).
Writing a “1” clears the associated ag.
相關(guān)PDF資料
PDF描述
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MC56603AGC60 24-BIT, 60 MHz, OTHER DSP, PBGA144
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參數(shù)描述
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