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參數(shù)資料
| 型號： | MC9S12E256CFU |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MC9S12E-Family Device User Guide V01.04 |
| 中文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | QFP-80 |
| 文件頁數(shù)： | 78/156頁 |
| 文件大?。?/td> | 3077K |
| 代理商： | MC9S12E256CFU |
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Device User Guide — 9S12E128DGV1/D V01.04
78
2.2 Signal Properties Summary
Table 2-1 Signal Properties
Internal Pull
Resistor
CTRL
VDDPLL
NA
VDDPLL
NA
VDDPLL
NA
VDDX
None
VDDX
Up
NA
NA
PERAD/
PPSAD
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Power
Domain
Description
Reset State
NA
NA
NA
None
Up
NA
EXTAL
XTAL
XFC
RESET
BKGD
TEST
—
—
—
—
—
—
—
—
Oscillator pins
PLL loop filter pin
External reset pin
Background debug, mode pin, tag signal high
Test pin only
MODC
VPP
TAGHI
—
PAD[15:0]
AN[15:0]
KWAD[15:0}
VDDX
Disabled
Port AD I/O Pins, ATD inputs, keypad Wake-up
PA[7:0]
ADDR[15:8]/
DATA[15:8]
ADDR[7:0]/
DATA[7:0]
NOACC
—
VDDX
PUCR
Disabled
Port A I/O pin, multiplexed address/data
PB[7:0]
—
VDDX
PUCR
Disabled
Port B I/O pin, multiplexed address/data
PE7
XCLKS
VDDX
Input
While RESET is low:
Down
While RESET is low:
Down
Mode Dep
1
Mode Dep
(1)
Port E I/O pin, low strobe, tag signal low
Mode Dep
(1)
Port E I/O pin, R/W
in expanded modes
PUCR
Up
Port E input, external interrupt pin
PUCR
Up
Port E input, non-maskable interrupt pin
PUCR
Up
Port K I/O Pin, Emulation Chip Select
PUCR
Up
Port K I/O Pin, External Chip Select
PUCR
Up
Port K I/O Pins, Extended Addresses
PERM/
PPSM
PERM/
PPSM
PERM/
PPSM
PERM/
PPSM
PERM/
PPSM
PERM/
PPSM
PERM/
PPSM
PERP/
PPSP
Input
Port E I/O pin, access, clock select
PE6
IPIPE1
MODB
VDDX
Port E I/O pin, pipe status, mode selection
PE5
IPIPE0
MODA
VDDX
Port E I/O pin, pipe status, mode selection
PE4
ECLK
—
VDDX
PUCR
Port E I/O pin, bus clock output
PE3
LSTRB
TAGLO
VDDX
PUCR
PE2
R/W
—
VDDX
PUCR
PE1
PE0
PK[7]
PK[6]
PK[5:0]
IRQ
XIRQ
ECS
XCS
—
—
VDDX
VDDX
VDDX
VDDX
VDDX
ROMCTL
—
—
XADDR[19:14]
PM7
SCL
—
VDDX
Up
Port M I/O Pin, IIC SCL signal
PM6
SDA
—
VDDX
Up
Port M I/O Pin, IIC SDA signal
PM5
TXD2
—
VDDX
Up
Port M I/O Pin, SCI2 transmit signal
PM4
RXD2
—
VDDX
Up
Port M I/O Pin, SCI2 receive signal
PM3
—
—
VDDX
Disabled
Port M I/O Pin, IIC SDA signal
PM1
DAO1
—
VDDX
Disabled
Port M I/O Pin, DAC1 output
PM0
DAO0
—
VDDX
Disabled
Port M I/O Pin, DAC0 output
PP[5:0]
PW0[5:0]
—
VDDX
Disabled
Port P I/O Pins, PWM output
F
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n
.
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PDF描述 |
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