參數(shù)資料
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Chapter 10 Internal Clock Generator (S08ICGV4)
MC9S08LC60 Series Data Sheet: Technical Data, Rev. 4
Freescale Semiconductor
179
10.4.4
ICG Status Register 2 (ICGS2)
10.4.5
ICG Filter Registers (ICGFLTU, ICGFLTL)
76543210
R
0000000
DCOS
W
Reset
00000000
= Unimplemented or Reserved
Figure 10-9. ICG Status Register 2 (ICGS2)
Table 10-4. ICGS2 Register Field Descriptions
Field
Description
0
DCOS
DCO Clock Stable — The DCOS bit is set when the DCO clock (ICG2DCLK) is stable, meaning the count error
has not changed by more than nunlock for two consecutive samples and the DCO clock is not static. This bit is
used when exiting off state if CLKS = X1 to determine when to switch to the requested clock mode. It is also used
in self-clocked mode to determine when to start monitoring the DCO clock. This bit is cleared upon entering the
off state.
0 DCO clock is unstable.
1 DCO clock is stable.
76543210
R
0000
FLT
W
Reset
00000000
= Unimplemented or Reserved
Figure 10-10. ICG Upper Filter Register (ICGFLTU)
Table 10-5. ICGFLTU Register Field Descriptions
Field
Description
3:0
FLT
Filter Value — The FLT bits indicate the current lter value, which controls the DCO frequency. The FLT bits are
read only except when the CLKS bits are programmed to self-clocked mode (CLKS = 00). In self-clocked mode,
any write to ICGFLTU updates the current 12-bit lter value. Writes to the ICGFLTU register will not affect FLT if
a previous latch sequence is not complete.
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PDF描述
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參數(shù)描述
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MC9S08LC60 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU)
MC9S08LC60_0707 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU)
MC9S08LC6064E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU)
MC9S08LC6080E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU)
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