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參數(shù)資料
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Internal Clock Generator (S08ICGV4)
MC9S08GT16A/GT8A Data Sheet, Rev. 1
Freescale Semiconductor
131
9.3
Register Denition
Refer to the direct-page register summary in the Memory chapter of this data sheet for the absolute address
assignments for all ICG registers. This section refers to registers and control bits only by their names. A
Freescale-provided equate or header le is used to translate these names into the appropriate absolute
addresses.
9.3.1
ICG Control Register 1 (ICGC1)
76543210
R
HGO1
1 This bit can be written only once after reset. Additional writes are ignored.
RANGE
REFS
CLKS
OSCSTEN
LOCD
0
W
Reset
01000100
= Unimplemented or Reserved
Figure 9-6. ICG Control Register 1 (ICGC1)
Table 9-1. ICGC1 Register Field Descriptions
Field
Description
7
HGO
High Gain Oscillator Select — The HGO bit is used to select between low power operation and high gain
operation for improved noise immunity. This bit is write-once after reset.
0
Oscillator congured for low power operation.
1
Oscillator congured for high gain operation.
6
RANGE
Frequency Range Select — The RANGE bit controls the oscillator, reference divider, and FLL loop prescaler
multiplication factor (P). It selects one of two reference frequency ranges for the ICG. The RANGE bit is
write-once after a reset. The RANGE bit only has an effect in FLL engaged external and FLL bypassed external
modes.
0
Oscillator congured for low frequency range. FLL loop prescale factor P is 64.
1
Oscillator congured for high frequency range. FLL loop prescale factor P is 1.
5
REFS
External Reference Select — The REFS bit controls the external reference clock source for ICGERCLK. The
REFS bit is write-once after a reset.
0
External clock requested.
1
Oscillator using crystal or resonator requested.
4:3
CLKS
Clock Mode Select — The CLKS bits control the clock mode as described below. If FLL bypassed external is
requested, it will not be selected until ERCS = 1. If the ICG enters off mode, the CLKS bits will remain
unchanged. Writes to the CLKS bits will not take effect if a previous write is not complete.
00 Self-clocked
01 FLL engaged, internal reference
10 FLL bypassed, external reference
11 FLL engaged, external reference
The CLKS bits are writable at any time, unless the rst write after a reset was CLKS = 0X, the CLKS bits cannot
be written to 1X until after the next reset (because the EXTAL pin was not reserved).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC9S08SL8CTL | MCU 8KB FLASH SLIC 28TSSOP |
| VE-B31-CU-F4 | CONVERTER MOD DC/DC 12V 200W |
| VE-B31-CU-F1 | CONVERTER MOD DC/DC 12V 200W |
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| 559596-2 | ADPT PLATE ASSY SC-SC DUP BL |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MC9S08GW32CLK | 功能描述:8位微控制器 -MCU S08 8bit Microcontroller RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| MC9S08GW64 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Covers: MC9S08GW64 and MC9S08GW32 |
| MC9S08GW64_11 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HC08 instruction set with added BGND instruction |
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