參數(shù)資料
型號(hào)： MC9S08GT32ACFDER
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 236/302頁(yè)
文件大小： 0K
描述： MCU 8BIT 32K FLASH 48-QFN
標(biāo)準(zhǔn)包裝： 2,000
系列： S08
核心處理器： S08
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SCI，SPI
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 39
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 48-VFQFN 裸露焊盤
包裝： 帶卷 (TR)
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Chapter 3 Modes of Operation
MC9S08GB60A Data Sheet, Rev. 2
Freescale Semiconductor
39
3.6.4
Active BDM Enabled in Stop Mode
Entry into the active background mode from run mode is enabled if the ENBDM bit in BDCSCR is set.
This register is described in the Chapter 15, “Development Support,” section of this data sheet. If ENBDM
is set when the CPU executes a STOP instruction, the system clocks to the background debug logic remain
active when the MCU enters stop mode so background debug communication is still possible. In addition,
the voltage regulator does not enter its low-power standby state but maintains full internal regulation. If
the user attempts to enter either stop1 or stop2 with ENBDM set, the MCU will instead enter stop3.
Most background commands are not available in stop mode. The memory-access-with-status commands
do not allow memory access, but they report an error indicating that the MCU is in either stop or wait
mode. The BACKGROUND command can be used to wake the MCU from stop and enter active
background mode if the ENBDM bit is set. After the device enters background debug mode, all
background commands are available. The table below summarizes the behavior of the MCU in stop when
entry into the background debug mode is enabled.
3.6.5
LVD Enabled in Stop Mode
The LVD system is capable of generating either an interrupt or a reset when the supply voltage drops below
the LVD voltage. If the LVD is enabled in stop by setting the LVDE and the LVDSE bits in SPMSC1 when
the CPU executes a STOP instruction, then the voltage regulator remains active during stop mode. If the
user attempts to enter either stop1 or stop2 with the LVD enabled for stop (LVDSE = 1), the MCU will
instead enter stop3. The table below summarizes the behavior of the MCU in stop when the LVD is
enabled.
3.6.6
On-Chip Peripheral Modules in Stop Modes
When the MCU enters any stop mode, system clocks to the internal peripheral modules are stopped. Even
in the exception case (ENBDM = 1), where clocks to the background debug logic continue to operate,
Table 3-2. BDM Enabled Stop Mode Behavior
Mode
PDC
PPDC
CPU, Digital
Peripherals,
Flash
RAM
ICG
ATD
Regulator
I/O Pins
RTI1
1 The 1 kHz internal RTI clock is not available in stop3 with active BDM enabled.
Stop3
Don’t
care
Don’t
care
Standby
Active
Disabled2
2 Either ATD stop mode or power-down mode depending on the state of ATDPU.
Active
States held
Optionally on
Table 3-3. LVD Enabled Stop Mode Behavior
Mode
PDC
PPDC
CPU, Digital
Peripherals,
Flash
RAM
ICG
ATD
Regulator
I/O Pins
RTI
Stop3
Don’t
care
Don’t
care
Standby
Disabled1
1 Either ATD stop mode or power-down mode depending on the state of ATDPU.
Active
States held
Optionally on
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PDF描述
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