MC68HC908LD64 — Rev. 3.0
參數(shù)資料
型號(hào)： MC908LD64IFUE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 283/362頁(yè)
文件大小： 0K
描述： IC MCU 8BIT FOR LCD 64-QFP
標(biāo)準(zhǔn)包裝： 420
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 6MHz
連通性： I²C，USB
外圍設(shè)備： OSD，POR，PWM
輸入/輸出數(shù)： 39
程序存儲(chǔ)器容量： 60KB（60K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x8b
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 85°C
封裝/外殼： 64-QFP
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Electrical Specifications
USB DC Electrical Characteristics
MC68HC908LD64 — Rev. 3.0
Data Sheet
Freescale Semiconductor
Electrical Specifications
353
24.12.4 USB Signaling Levels
Table 24-14. USB Signaling Levels
Bus State
Signaling Levels
From Originating Driver
At Receiver
Differential “1”
(D+) – (D–) > 200 mV and D+ or D– > VSE (min.)
Differential “0”
(D+) – (D–) < –200 mV and D+ or D– > VSE (min.)
Data J State:
Low Speed
Full Speed
Differential “0”
Differential “1”
Data K State:
Low Speed
Full Speed
Differential “1”
Differential “0”
Idle State:
Low Speed
Full Speed
Differential “0” and D– > VSE (max.) and D+ < VSE (min.)
Differential “1” and D+ > VSE (max.) and D– < VSE (min.)
Resume State:
Low Speed
Full Speed
Differential “1” and D+ > VSE (max.) and D– < VSE (min.)
Differential “0” and D– > VSE (max.) and D+ < VSE (min.)
Start of Packet (SOP)
Data lines switch from Idle to K State
End of Packet (EOP)
D+ and D– < VSE (min) for 2 bit
times(1) followed by an Idle for 1 bit
time
Notes:
1. The width of EOP is defined in bit times relative to the speed of transmission.
D+ and D– < VSE(min) for ≥ 1 bit
time(2) followed by a J State
2. The width of EOP is defined in bit times relative to the device type receiving the EOP.
Disconnect
(Upstream only)
—
D+ and D– < VSE(max) for ≥ 2.5 s
Connect
(Upstream only)
—
D+ or D– > VSE(max) for ≥ 2.5 s
Reset
(Downstream only)
D+ and D– < VSE for ≥10 ms
D+ and D– < VSE (min) for ≥ 2.5 s
(must be recognized within 5.5
s)(3)
3. These times apply to an active device that is not in the suspend state.
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PDF描述
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