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參數(shù)資料
| 型號： | MC908JL3CPE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 39/212頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 4K FLASH 28-PDIP |
| 標準包裝： | 13 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 外圍設備： | LED，LVD，POR，PWM |
| 輸入/輸出數(shù)： | 23 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.3 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-DIP（0.600"，15.24mm） |
| 包裝： | 管件 |
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Timer Interface Module (TIM)
MC68H(R)C908JL3 — Rev. 1.1
Technical Data
Freescale Semiconductor
Timer Interface Module (TIM)
131
NOTE:
Reset the TIM counter before writing to the TIM counter modulo registers.
10.10.4 TIM Channel Status and Control Registers (TSC0:TSC1)
Each of the TIM channel status and control registers does the following:
Flags input captures and output compares
Enables input capture and output compare interrupts
Selects input capture, output compare, or PWM operation
Selects high, low, or toggling output on output compare
Selects rising edge, falling edge, or any edge as the active input
capture trigger
Selects output toggling on TIM overflow
Selects 100% PWM duty cycle
Selects buffered or unbuffered output compare/PWM operation
Address:
$0023
TMODH
Bit 7
654321
Bit 0
Read:
Bit15
Bit14
Bit13
Bit12
Bit11
Bit10
Bit9
Bit8
Write:
Reset:
11111111
Address:
$0024
TMODL
Bit 7
654321
Bit 0
Read:
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
Write:
Reset:
11111111
Figure 10-6. TIM Counter Modulo Registers (TMODH:TMODL)
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