參數(shù)資料
      型號: MC908GR32ACFAER
      廠商: Freescale Semiconductor
      文件頁數(shù): 128/314頁
      文件大?。?/td> 0K
      描述: IC MCU 32K FLASH 8MHZ 48-LQFP
      標準包裝: 2,000
      系列: HC08
      核心處理器: HC08
      芯體尺寸: 8-位
      速度: 8MHz
      連通性: SCI,SPI
      外圍設備: LVD,POR,PWM
      輸入/輸出數(shù): 37
      程序存儲器容量: 32KB(32K x 8)
      程序存儲器類型: 閃存
      RAM 容量: 1.5K x 8
      電壓 - 電源 (Vcc/Vdd): 3 V ~ 5.5 V
      數(shù)據(jù)轉(zhuǎn)換器: A/D 24x10b
      振蕩器型: 內(nèi)部
      工作溫度: -40°C ~ 85°C
      封裝/外殼: 48-LQFP
      包裝: 帶卷 (TR)
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      Interrupts
      MC68HC908GR60A MC68HC908GR48A MC68HC908GR32A Data Sheet, Rev. 5
      Freescale Semiconductor
      213
      In a slave SPI (MSTR = 0), MODF generates an SPI receiver/error CPU interrupt request if the ERRIE bit
      is set. The MODF bit does not clear the SPE bit or reset the SPI in any way. Software can abort the SPI
      transmission by clearing the SPE bit of the slave.
      NOTE
      A high on the SS pin of a slave SPI puts the MISO pin in a high impedance
      state. Also, the slave SPI ignores all incoming SPSCK clocks, even if it was
      already in the middle of a transmission.
      To clear the MODF flag, read the SPSCR with the MODF bit set and then write to the SPCR register. This
      entire clearing mechanism must occur with no MODF condition existing or else the flag is not cleared.
      15.7 Interrupts
      Four SPI status flags can be enabled to generate CPU interrupt requests. See Table 15-1.
      Reading the SPI status and control register with SPRF set and then reading the receive data register
      clears SPRF. The clearing mechanism for the SPTE flag is always just a write to the transmit data register.
      The SPI transmitter interrupt enable bit (SPTIE) enables the SPTE flag to generate transmitter CPU
      interrupt requests, provided that the SPI is enabled (SPE = 1).
      The SPI receiver interrupt enable bit (SPRIE) enables SPRF to generate receiver CPU interrupt requests,
      regardless of the state of SPE. See Figure 15-12.
      Figure 15-12. SPI Interrupt Request Generation
      Table 15-1. SPI Interrupts
      Flag
      Request
      SPTE
      Transmitter empty
      SPI transmitter CPU interrupt request
      (SPTIE = 1, SPE = 1)
      SPRF
      Receiver full
      SPI receiver CPU interrupt request
      (SPRIE = 1)
      OVRF
      Overflow
      SPI receiver/error interrupt request
      (ERRIE = 1)
      MODF
      Mode fault
      SPI receiver/error interrupt request
      (ERRIE = 1)
      SPTE
      SPTIE
      SPRF
      SPRIE
      SPE
      CPU INTERRUPT REQUEST
      SPI TRANSMITTER
      SPI RECEIVER/ERROR
      ERRIE
      MODF
      OVRF
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