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參數(shù)資料
| 型號： | UPD78F4225YGC-8BT-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 69/626頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 16BIT 128K FLASH |
| 標準包裝： | 200 |
| 系列： | 78K4 |
| 核心處理器： | 78K/IV |
| 芯體尺寸： | 8/16-位 |
| 速度： | 12.5MHz |
| 連通性： | 3 線 SIO，I²C，IOE，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 59 |
| 程序存儲器容量： | 128KB（128K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 4K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.9 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8b; D/A 2x8b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 托盤 |
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158
CHAPTER 8
16-BIT TIMER/EVENT COUNTER
User’s Manual U12697EJ4V1UD
8.4.2 PPG output operation
The 16-bit timer/event counter can be used for PPG (Programmable Pulse Generator) output by setting 16-bit timer
mode control register 0 (TMC0) and capture/compare control register 0 (CRC0) as shown in Figure 8-9.
The PPG output function outputs a rectangular wave with a cycle specified by the count value set in advance to
16-bit capture/compare register 00 (CR00) and a pulse width specified by the count value set in advance to 16-bit
capture/compare register 01 (CR01).
Figure 8-9. Control Register Settings in PPG Output Operation
(a) 16-bit timer mode control register 0 (TMC0)
0000
TMC03
1
TMC02
1
TMC01
0
OVF0
0
TMC0
Clears and starts on
match between
TM0 and CR00.
(b) Capture/compare control register 0 (CRC0)
00000
CRC02
0
CRC01
×
CRC00
0
CRC0
CR00 used as compare register
CR01 used as compare register
(c) 16-bit timer output control register 0 (TOC0)
0
OSPT
0
OSPE
0
TOC04
1
LVS0
0/1
LVR0
0/1
TOC01
1
TOE0
1
TOC0
Enables TO0 output.
Reverses output on match
between TM0 and CR01.
Disables one-shot pulse output.
Specifies initial value of
TO0 output.
Reverses output on match
between TM0 and CR00.
Remark
×: Don’t care
Caution Make sure that CR00 and CR01 are set to 0000H
≤ CR01 < CR00 ≤ FFFFH.
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