參數(shù)資料
型號： MC88916DW
廠商： MOTOROLA INC
元件分類： 時鐘及定時
英文描述： LOW SKEW CMOS PLL CLOCK DRIVER WITH PROCESSOR RESET
中文描述： MC88 SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PDSO20
封裝： PLASTIC, SOIC-20
文件頁數(shù)： 4/9頁
文件大?。?/td> 114K
代理商： MC88916DW
MC88916
MOTOROLA
TIMING SOLUTIONS
BR1333 — REV 5
4
Figure 1. MC88916 Logic Block Diagram
Q
Q
R
D
Q1
Q
Q
R
D
Q2
Q
Q
R
D
Q3
Q
Q
R
D
Q/2
Q
Q
R
D
Q0
VCO
CH
PUMP
PFD
SYNC
PLL_EN
MR
POWER–ON
RESET
0
1
LOCK INDICATOR AND
RESET_OUT 1024 CYCLE
COUNT CIRCUITRY
RST_IN
2X_Q
RST_OUT
SYNC INPUT TIMING REQUIREMENTS
Symbol
Parameter
Minimum
Maximum
Unit
tRISE/FALL
SYNC Input
Rise/Fall Time, SYNC Input
From 0.8V to 2.0V
—
5.0
ns
tCYCLE,
Input Clock Period
‘DW70
‘DW80
SYNC Input
SYNC Input
57
50
200
ns
Duty Cycle
Duty Cycle, SYNC Input
50%
±
25%
FREQUENCY SPECIFICATIONS
(TA = –40
°
C to +85
°
C; VCC = 5.0V
±
5%)
Guaranteed Minimum
Symbol
Parameter
MC88916DW70
MC88916DW80
Unit
Fmax (2X_Q)
Maximum Operating Frequency, 2X_Q Output
70
80
MHz
Fmax (‘Q’)
Maximum Operating Frequency, Q0–Q2, Q3 Outputs
35
40
MHz
1. Maximum Operating Frequency is guaranteed with the 88916 in a phase–locked condition, and all outputs loaded at 50
terminated to VCC/2.
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PDF描述
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