參數(shù)資料
型號(hào)： MC74LVX595M
廠商： ON SEMICONDUCTOR
元件分類： 計(jì)數(shù)移位寄存器
英文描述： LV/LV-A/LVX/H SERIES, 8-BIT RIGHT SERIAL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PDSO16
封裝： EIAJ, SOIC-16
文件頁數(shù)： 14/14頁
文件大?。?/td> 339K
代理商： MC74LVX595M
MC74LVX595
http://onsemi.com
9
D1
FOR COMPONENTS
10 PITCHES
CUMULATIVE
TOLERANCE ON
TAPE
±0.2 mm
(±0.008”)
2.0 mm × 1.2 mm
AND LARGER
CENTER
LINES
OF CAVITY
EMBOSSMENT
USER DIRECTION OF FEED
K0
SEE
NOTE 2
P0
P2
D
E
F W
B0
+
K
t
B1
TOP
COVER
TAPE
P
SEE NOTE 2
A0
FOR MACHINE REFERENCE
ONLY
INCLUDING DRAFT AND RADII
CONCENTRIC AROUND B0
R MIN.
TAPE AND COMPONENTS
SHALL PASS AROUND RADIUS “R”
WITHOUT DAMAGE
BENDING RADIUS
*TOP COVER
TAPE THICKNESS (t1)
0.10 mm
(0.004”) MAX.
EMBOSSED
CARRIER
EMBOSSMENT
TYPICAL
COMPONENT CAVITY
CENTER LINE
TYPICAL
COMPONENT
CENTER LINE
MAXIMUM COMPONENT ROTATION
10°
CAMBER (TOP VIEW)
ALLOWABLE CAMBER TO BE 1 mm/100 mm NONACCUMULATIVE OVER 250 mm
100 mm
(3.937”)
1 mm
(0.039”) MAX
250 mm
(9.843”)
1 mm MAX
TAPE
2. A0, B0, and K0 are determined by component size. The clearance between the components and the cavity must be within 0.05 mm min to
0.50 mm max. The component cannot rotate more than 10° within the determined cavity
Figure 15. Carrier Tape Specifications
相關(guān)PDF資料
PDF描述
MC74VCX16240DT ALVC/VCX/A SERIES, QUAD 4-BIT DRIVER, INVERTED OUTPUT, PDSO48
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MC74VHC1G01DFT4 AHC/VHC SERIES, 2-INPUT NAND GATE, PDSO5
MC74VHC1G125DF2G AHC/VHC SERIES, 1-BIT DRIVER, TRUE OUTPUT, PDSO5
MC74VHC1GT04DFT2G AHC/VHC SERIES, 1-INPUT INVERT GATE, PDSO5
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參數(shù)描述
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