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參數(shù)資料
| 型號： | MC74HC4020ANG |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 8/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC COUNTER RIPPLE 14STAGE 16DIP |
| 標準包裝： | 500 |
| 系列： | 74HC |
| 邏輯類型： | 二進制計數(shù)器 |
| 方向： | 上 |
| 元件數(shù)： | 1 |
| 每個元件的位元數(shù)： | 14 |
| 復位： | 異步 |
| 計數(shù)速率： | 50MHz |
| 觸發(fā)器類型： | 負邊沿 |
| 電源電壓： | 2 V ~ 6 V |
| 工作溫度： | -55°C ~ 125°C |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 16-DIP（0.300"，7.62mm） |
| 供應(yīng)商設(shè)備封裝： | 16-DIP |
| 包裝： | 管件 |
| 其它名稱： | MC74HC4020ANGOS |
MC74HC4020A
http://onsemi.com
5
AC CHARACTERISTICS (CL = 50 pF, Input tr = tf = 6 ns)
Symbol
Parameter
VCC
V
Guaranteed Limit
Unit
55 to 25°C
≤85°C
≤125°C
fmax
Maximum Clock Frequency (50% Duty Cycle)
(Figures 1 and 4)
2.0
3.0
4.5
6.0
10
15
30
50
9.0
14
28
50
8.0
12
25
40
MHz
tPLH,
tPHL
Maximum Propagation Delay, Clock to Q1*
(Figures 1 and 4)
2.0
3.0
4.5
6.0
96
63
31
25
106
71
36
30
115
88
40
35
ns
tPHL
Maximum Propagation Delay, Reset to Any Q
(Figures 2 and 4)
2.0
3.0
4.5
6.0
65
30
26
72
36
35
32
90
40
35
ns
tPLH,
tPHL
Maximum Propagation Delay, Qn to Qn+1
(Figures 3 and 4)
2.0
3.0
4.5
6.0
69
40
17
14
80
45
21
15
90
50
28
22
ns
tTLH,
tTHL
Maximum Output Transition Time, Any Output
(Figures 1 and 4)
2.0
3.0
4.5
6.0
75
27
15
13
95
32
19
15
110
36
22
19
ns
Cin
Maximum Input Capacitance
10
pF
* For TA = 25°C and CL = 50 pF, typical propagation delay from Clock to other Q outputs may be calculated with the following equations:
VCC = 2.0 V: tP = [93.7 + 59.3 (n1)] ns
VCC = 4.5 V: tP = [30.25 + 14.6 (n1)] ns
VCC = 3.0 V: tP = [61.5 + 34.4 (n1)] ns
VCC = 6.0 V: tP = [24.4 + 12 (n1)] ns
CPD
Power Dissipation Capacitance (Per Package)*
Typical @ 25°C, VCC = 5.0 V
pF
38
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