參數(shù)資料
型號： MC68P11E1VFN2R2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, 2 MHz, MICROCONTROLLER, PQCC52
封裝： PLASTIC, QCC-52
文件頁數(shù)： 25/336頁
文件大?。?/td> 3387K
代理商： MC68P11E1VFN2R2
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Technical Data
MC68HC11E Family — Rev. 4
120
Resets and Interrupts
MOTOROLA
Resets and Interrupts
MDA — Mode Select A Bit
The mode select A bit reflects the status of the MODA input pin at the
rising edge of reset. Refer to Section 4. Operating Modes and
On-Chip Memory for more information.
IRVNE — Internal Read Visibility/Not E Bit
The IRVNE control bit allows internal read accesses to be available
on the external data bus during operation in expanded modes. In
single-chip and bootstrap modes, IRVNE determines whether the E
clock is driven out an external pin. For the MC68HC811E2, this bit is
IRV and only controls internal read visibility. Refer to Section 4.
PSEL[3:0] — Priority Select Bits
These bits select one interrupt source to be elevated above all other
I-bit-related sources and can be written only while the I bit in the CCR
is set (interrupts disabled).
Table 5-3. Highest Priority Interrupt Selection
PSEL[3:0]
Interrupt Source Promoted
0 0 0 0
Timer overflow
0 0 0 1
Pulse accumulator overflow
0 0 1 0
Pulse accumulator input edge
0 0 1 1
SPI serial transfer complete
0 1 0 0
SCI serial system
0 1 0 1
Reserved (default to IRQ)
0 1 1 0
IRQ (external pin or parallel I/O)
0 1 1 1
Real-time interrupt
1 0 0 0
Timer input capture 1
1 0 0 1
Timer input capture 2
1 0 1 0
Timer input capture 3
1 0 1 1
Timer output compare 1
1 1 0 0
Timer output compare 2
1 1 0 1
Timer output compare 3
1 1 1 0
Timer output compare 4
1 1 1 1
Timer input capture 4/output compare 5
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MC-68PLCC-SMT 制造商:SPC Multicomp 功能描述:PLCC SOCKET 68POS SURFACE MOUNT
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