參數資料
        型號: MC68HCP11E1CFNE3
        廠商: Freescale Semiconductor
        文件頁數: 174/242頁
        文件大?。?/td> 0K
        描述: IC MCU 8BIT 52-PLCC
        標準包裝: 23
        系列: HC11
        核心處理器: HC11
        芯體尺寸: 8-位
        速度: 3MHz
        連通性: SCI,SPI
        外圍設備: POR,WDT
        輸入/輸出數: 38
        程序存儲器類型: ROMless
        EEPROM 大?。?/td> 512 x 8
        RAM 容量: 512 x 8
        電壓 - 電源 (Vcc/Vdd): 4.5 V ~ 5.5 V
        數據轉換器: A/D 8x8b
        振蕩器型: 內部
        工作溫度: -40°C ~ 85°C
        封裝/外殼: 52-LCC(J 形引線)
        包裝: 管件
        第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁當前第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁
        Memory Map
        M68HC11E Family Data Sheet, Rev. 5.1
        Freescale Semiconductor
        37
        $1025
        Timer Interrupt Flag 2
        (TFLG2)
        Read:
        TOF
        RTIF
        PAOVF
        PAIF
        Write:
        Reset:
        0
        $1026
        Pulse Accumulator Control Regis-
        ter (PACTL)
        Read:
        DDRA7
        PAEN
        PAMOD
        PEDGE
        DDRA3
        I4/O5
        RTR1
        RTR0
        Write:
        Reset:
        0
        $1027
        Pulse Accumulator Count Regis-
        ter (PACNT)
        Read:
        Bit 7
        Bit 6
        Bit 5
        Bit 4
        Bit 3
        Bit 2
        Bit 1
        Bit 0
        Write:
        Reset:
        Indeterminate after reset
        $1028
        Serial Peripheral Control Register
        (SPCR)
        Read:
        SPIE
        SPE
        DWOM
        MSTR
        CPOL
        CPHA
        SPR1
        SPR0
        Write:
        Reset:
        0
        1
        U
        $1029
        Serial Peripheral Status Register
        (SPSR)
        Read:
        SPIF
        WCOL
        MODF
        Write:
        Reset:
        0
        $102A
        Serial Peripheral Data I/O Regis-
        ter (SPDR)
        Read:
        Bit 7
        Bit 6
        Bit 5
        Bit 4
        Bit 3
        Bit 2
        Bit 1
        Bit 0
        Write:
        Reset:
        Indeterminate after reset
        $102B
        Baud Rate Register
        (BAUD)
        Read:
        TCLR
        SCP2(1)
        SCP1
        SCP0
        RCKB
        SCR2
        SCR1
        SCR0
        Write:
        Reset:
        0
        U
        $102C
        Serial Communications Control
        Register 1 (SCCR1)
        Read:
        R8
        T8
        M
        WAKE
        Write:
        Reset:
        I
        0
        $102D
        Serial Communications Control
        Register 2 (SCCR2)
        Read:
        TIE
        TCIE
        RIE
        ILIE
        TE
        RE
        RWU
        SBK
        Write:
        Reset:
        0
        $102E
        Serial Communications Status
        Register (SCSR)
        Read:
        TDRE
        TC
        RDRF
        IDLE
        OR
        NF
        FE
        Write:
        Reset:
        1
        0
        1. SCP2 adds
        ÷39 to SCI prescaler and is present only in MC68HC(7)11E20.
        $102F
        Serial Communications Data Reg-
        ister (SCDR)
        Read:
        R7/T7
        R6/T6
        R5/T5
        R4/T4
        R3/T3
        R2/T2
        R1/T1
        R0/T0
        Write:
        Reset:
        Indeterminate after reset
        $1030
        Analog-to-Digital Control Status
        Register (ADCTL)
        Read:
        CCF
        SCAN
        MULT
        CD
        CC
        CB
        CA
        Write:
        Reset:
        0
        Indeterminate after reset
        Addr.
        Register Name
        Bit 7
        6
        5
        4
        3
        2
        1
        Bit 0
        = Unimplemented
        R
        = Reserved
        U = Unaffected
        I = Indeterminate after reset
        Figure 2-7. Register and Control Bit Assignments (Sheet 4 of 6)
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