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參數(shù)資料
| 型號： | MC68HCL05J1A |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | TRANSISTOR,BJT,NPN,20V V(BR)CEO,400MA I(C),TO-39 |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 28/128頁 |
| 文件大?。?/td> | 1620K |
| 代理商： | MC68HCL05J1A |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁當前第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁
Technical Data
MC68HC05J1A — Rev. 3.0
28
Memory
MOTOROLA
Memory
2.4 Input/Output (I/O) Section
The first 32 addresses of the memory space, $0001–$001F, are the I/O
section. These are the addresses of the I/O control registers, status
registers, and data registers. See
Figure 2-2
.
One I/O register shown in
Figure 2-2
is located outside the 32-byte I/O
section: the computer operating properly (COP) register is mapped at
$07F0.
2.5 Random-Access Memory (RAM)
The 64 addresses from $00C0 to $00FF serve as both the user RAM and
the stack RAM. The CPU uses five stack RAM bytes to save all CPU
register contents before processing an interrupt. During a subroutine
call, the CPU uses two bytes to store the return address. The stack
pointer decrements during pushes and increments during pulls.
NOTE:
Be careful when using nested subroutines or multiple interrupt levels.
The CPU may overwrite data in the RAM during a subroutine or during
the interrupt stacking operation.
2.6 Read-Only Memory (ROM)
The ROM is located in two areas of the memory map:
1.
Addresses $0300–$07CF contain 1232 bytes of user ROM.
2.
Addresses $07F8–$07FF contain 16 bytes of ROM reserved for
user vectors.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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參數(shù)描述 |
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