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參數(shù)資料
| 型號： | MC68HC908KX2CP |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 187/210頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 2K FLASH 8MHZ SCI 16-DIP |
| 標(biāo)準(zhǔn)包裝： | 25 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 連通性： | SCI |
| 外圍設(shè)備： | LVD，POR，PWM |
| 輸入/輸出數(shù)： | 13 |
| 程序存儲器容量： | 2KB（2K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 192 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 4x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 16-DIP（0.300"，7.62mm） |
| 包裝： | 管件 |
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Internal Clock Generator Module (ICG)
MC68HC908KX8 MC68HC908KX2 MC68HC08KX8 Data Sheet, Rev. 2.1
78
Freescale Semiconductor
7.4.1 Switching Clock Sources
Switching from one clock source to another requires both clock sources to be enabled and stable. A
simple flow requires:
1.
Enable desired clock source
2.
Wait for it to become stable
3.
Switch clocks
4.
Disable previous clock source
The key point to remember in this flow is that the clock source cannot be switched (CS cannot be written)
unless the desired clock is on and stable. A short assembly code example of how to employ this flow is
shown in Figure 7-8. This code is for illustrative purposes only and does not represent valid syntax for any
particular assembler.
;Clock Switching Code Example
;This code switches from Internal to External clock
;Clock Monitor and interrupts are not enabled
start
lda
#$13
;Mask for CS, ECGON, ECGS
; If switching from External to Internal, mask is $0C.
loop
**
;Other code here, such as writing the COP, since ECGS may
; take some time to set
sta
icgcr
;Try to set CS, ECGON and clear ICGON. ICGON will not
; clear until CS is set, and CS will not set until
; ECGON and ECGS are set.
cmpa
icgcr
;Check to see if ECGS set, then CS set, then ICGON clear
bne
loop
;Keep looping until ICGON is clear.
Figure 7-8. Code Example for Switching Clock Sources
7.4.2 Enabling the Clock Monitor
Many applications require the clock monitor to determine if one of the clock sources has become inactive,
so the other can be used to recover from a potentially dangerous situation. Using the clock monitor
requires both clocks to be active (ECGON and ICGON both set). To enable the clock monitor, both clocks
must also be stable (ECGS and ICGS both set). This is to prevent the use of the clock monitor when a
clock is first turned on and potentially unstable.
Enabling the clock monitor and clock monitor interrupts requires a flow similar to the one below:
1.
Enable the alternate clock source
2.
Wait for both clock sources to be stable
3.
Switch to the desired clock source if necessary
4.
Enable the clock monitor
5.
Enable clock monitor interrupts
These events must happen in sequence. A short assembly code example of how to employ this flow is
shown in Figure 7-9. This code is for illustrative purposes only and does not represent valid syntax for any
particular assembler.
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