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參數(shù)資料
| 型號： | MC68HC908GR16MFA |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 38/276頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 16K FLASH 8MHZ SPI 48LQFP |
| 標準包裝： | 250 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 連通性： | LIN，SCI，SPI |
| 外圍設備： | LVD，POR，PWM |
| 輸入/輸出數(shù)： | 37 |
| 程序存儲器容量： | 16KB（16K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 數(shù)據(jù)轉換器： | A/D 8x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 48-LQFP |
| 包裝： | 托盤 |
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Input/Output Ports (PORTS)
MC68HC908GR16 Data Sheet, Rev. 5.0
132
Freescale Semiconductor
When bit DDRDx is a 1, reading address $0003 reads the PTDx data latch. When bit DDRDx is a 0,
reading address $0003 reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its data direction bit. Table 12-5 summarizes the operation of the port D pins.
12.5.3 Port D Input Pullup Enable Register
The port D input pullup enable register (PTDPUE) contains a software configurable pullup device for each
of the eight port D pins. Each bit is individually configurable and requires that the data direction register,
DDRD, bit be configured as an input. Each pullup is automatically and dynamically disabled when a port
bit’s DDRD is configured for output mode.
PTDPUE7–PTDPUE0 — Port D Input Pullup Enable Bits
These writable bits are software programmable to enable pullup devices on an input port bit.
1 = Corresponding port D pin configured to have internal pullup
0 = Corresponding port D pin has internal pullup disconnected
Table 12-5. Port D Pin Functions
PTDPUE
Bit
DDRD
Bit
PTD
Bit
I/O Pin
Mode
Accesses to DDRD
Accesses to PTD
Read/Write
Read
Write
10
X(1)
1. X = Don’t care
Input, VDD
(2)
2. I/O pin pulled up to VDD by internal pullup device.
DDRD7–DDRD0
Pin
PTD7–PTD0(3)
3. Writing affects data register, but does not affect input.
00
X
Input, Hi-Z(4)
4. Hi-Z = High imp[edance
DDRD7–DDRD0
Pin
PTD7–PTD0(3)
X
1
X
Output
DDRD7–DDRD0
PTD7–PTD0
Address:
$000F
Bit 7
6
54
321
Bit 0
Read:
PTDPUE7 PTDPUE6 PTDPUE5 PTDPUE4 PTDPUE3 PTDPUE2 PTDPUE1 PTDPUE0
Write:
Reset:
00
000
0
Figure 12-16. Port D Input Pullup Enable Register (PTDPUE)
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