參數(shù)資料
型號： MC68HC711D3CFN2
廠商： Freescale Semiconductor
文件頁數(shù)： 11/124頁
文件大?。?/td> 0K
描述： IC MCU 2MHZ 4K OTP 44-PLCC
標(biāo)準(zhǔn)包裝： 26
系列： HC11
核心處理器： HC11
芯體尺寸： 8-位
速度： 2MHz
連通性： SCI，SPI
外圍設(shè)備： POR，WDT
輸入/輸出數(shù)： 26
程序存儲器容量： 4KB（4K x 8）
程序存儲器類型： OTP
RAM 容量： 192 x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LCC（J 形引線）
包裝： 管件
ELECTRICAL CHARACTERISTICS
A-4
TECHNICAL DATA
NOTES:
1. RESET is recognized during the first clock cycle it is held low. Internal circuitry then drives the pin low for four
clock cycles, releases the pin, and samples the pin level two cycles later to determine the source of the interrupt.
Refer to SECTION 5 RESETS AND INTERRUPTS for further detail.
2. All timing is shown with respect to 20% VDD and 70% VDD, unless otherwise noted.
Figure A-2 Timer Inputs
Table A-4 Control Timing
Characteristic
Symbol
1.0 MHz
2.0 MHz
3.0 MHz
Unit
Min
Max
Min
Max
Min
Max
Frequency of Operation
fo
dc
1.0
dc
2.0
dc
3.0
MHz
E-Clock Period
tcyc
1000
—
500
—
333
—
ns
Crystal Frequency
fXTAL
—4.0
—8.0
—
12.0
MHz
External Oscillator Frequency
4 fo
dc
4.0
dc
8.0
dc
12.0
MHz
Processor Control SetupTime
tPCSU = 1/4 tcyc + 50 ns
tPCSU
300
—
175
—
133
—
ns
Reset Input Pulse Width
To Guarantee External Reset Vector
Minimum Input Time
(Can Be Preempted by Internal Reset)
PWRSTL
8
1
—
8
1
—
8
1
—
tcyc
Mode Programming Setup Time
tMPS
2—
tcyc
Mode Programming Hold Time
tMPH
10
—
10
—
10
—
ns
Interrupt Pulse Width,
IRQ Edge-Sensitive Mode
PWIRQ = tcyc + 20 ns
PWIRQ
1020
—
520
—
353
—
ns
Wait Recovery Startup Time
tWRS
—4
tcyc
Timer Pulse Width,
Input Capture Pulse
Accumulator Input
PWTIM = tcyc + 20 ns
PWTIM
1020
—
520
—
353
—
ns
NOTES:
1. Rising edge sensitive input
2. Falling edge sensitive input
3. Maximum pulse accumulator clocking rate is E-clock frequency divided by 2.
PA7
2,3
PA7
1,3
PA[2:0]
2
PA[2:0]
1
PWTIM
TIMER INPUTS TIM
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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