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參數(shù)資料
| 型號： | MC68HC08GR32AVFU |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 14 X 14 MM, QFP-64 |
| 文件頁數(shù)： | 134/286頁 |
| 文件大?。?/td> | 2074K |
| 代理商： | MC68HC08GR32AVFU |
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Input/Output Registers
MC68HC08GR32A MC68HC08GR16A Data Sheet, Rev. 0
Freescale Semiconductor
219
Setting MS0B disables the channel 1 status and control register and reverts T1CH1 to general-purpose
I/O.
Reset clears the MSxB bit.
1 = Buffered output compare/PWM operation enabled
0 = Buffered output compare/PWM operation disabled
MSxA — Mode Select Bit A
When ELSxB:A
≠ 00, this read/write bit selects either input capture operation or unbuffered output
compare/PWM operation. See Table 17-3.
1 = Unbuffered output compare/PWM operation
0 = Input capture operation
When ELSxB:A = 00, this read/write bit selects the initial output level of the TCHx pin (see Table 17-3).
Reset clears the MSxA bit.
1 = Initial output level low
0 = Initial output level high
NOTE
Before changing a channel function by writing to the MSxB or MSxA bit, set
the TSTOP and TRST bits in the TIM1 status and control register (T1SC).
ELSxB and ELSxA — Edge/Level Select Bits
When channel x is an input capture channel, these read/write bits control the active edge-sensing logic
on channel x.
When channel x is an output compare channel, ELSxB and ELSxA control the channel x output
behavior when an output compare occurs.
When ELSxB and ELSxA are both clear, channel x is not connected to an I/O port, and pin TCHx is
available as a general-purpose I/O pin. Table 17-3 shows how ELSxB and ELSxA work. Reset clears
the ELSxB and ELSxA bits.
NOTE
After initially enabling a TIM1 channel register for input capture operation
and selecting the edge sensitivity, clear CHxF to ignore any erroneous
edge detection flags.
Table 17-3. Mode, Edge, and Level Selection
MSxB
MSxA
ELSxB
ELSxA
Mode
Configuration
X0
0
Output preset
Pin under port control; initial output level high
X
1
0
Pin under port control; initial output level low
00
0
1
Input capture
Capture on rising edge only
0
1
0
Capture on falling edge only
0
1
Capture on rising or falling edge
01
0
Output compare
or PWM
Software compare only
0
1
0
1
Toggle output on compare
0
1
0
Clear output on compare
0
1
Set output on compare
1X
0
1
Buffered output compare
or buffered PWM
Toggle output on compare
1
X
1
0
Clear output on compare
1
X
1
Set output on compare
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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