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參數(shù)資料
| 型號： | MC68HC08GP16AMFB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PQFP44 |
| 封裝： | PLASTIC, QFP-44 |
| 文件頁數(shù)： | 278/286頁 |
| 文件大?。?/td> | 3807K |
| 代理商： | MC68HC08GP16AMFB |
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External Interrupt (IRQ)
IRQ Pin
MC68HC08GP32A MC68HC08GP16A
Data Sheet
MOTOROLA
External Interrupt (IRQ)
91
Interrupt signals on the IRQ pin are latched into the IRQ latch. The interrupt latch
remains set until one of the following actions occurs:
Vector fetch — A vector fetch automatically generates an interrupt
acknowledge signal that clears the latch that caused the vector fetch.
Software clear — Software can clear the interrupt latch by writing a 1 to the
ACK bit in the interrupt status and control register (INTSCR).
Reset — A reset automatically clears the interrupt latch.
The external interrupt pin is falling-edge-triggered and is software-configurable to
be either falling-edge or falling-edge and low-level-triggered. The MODE bit in the
INTSCR controls the triggering sensitivity of the IRQ pin.
When set, the IMASK bit in the INTSCR masks all external interrupt requests. A
latched interrupt request is not presented to the interrupt priority logic unless the
IMASK bit is clear.
NOTE:
The interrupt mask (I) in the condition code register (CCR) masks all interrupt
requests, including external interrupt requests.
7.4 IRQ Pin
A falling edge on the IRQ pin can latch an interrupt request into the IRQ latch. A
vector fetch, software clear, or reset clears the IRQ latch.
If the MODE bit is set, the IRQ pin is both falling-edge-sensitive and
low-level-sensitive. With MODE set, both of the following actions must occur to
clear IRQ:
Vector fetch or software clear — A vector fetch generates an interrupt
acknowledge signal to clear the latch. Software may generate the interrupt
acknowledge signal by writing a 1 to the ACK bit in the interrupt status and
control register (INTSCR). The ACK bit is useful in applications that poll the
IRQ pin and require software to clear the IRQ latch. Writing to the ACK bit
prior to leaving an interrupt service routine can also prevent spurious
interrupts due to noise. Setting ACK does not affect subsequent transitions
on the IRQ pin. A falling edge that occurs after writing to the ACK bit another
interrupt request. If the IRQ mask bit, IMASK, is clear, the CPU loads the
program counter with the vector address at locations $FFFA and $FFFB.
Return of the IRQ pin to a high level — As long as the IRQ pin is low, IRQ
remains active.
Addr.
Register Name
Bit 7
654321
Bit 0
$001D
IRQ Status and Control
Register (INTSCR)
Read:
0000
IRQF
0
IMASK
MODE
Write:
ACK
Reset:
00000000
= Unimplemented
Figure 7-3. IRQ I/O Register Summary
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC08GP16AVFB | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PQFP44 |
| MC68HC08GP32VB | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| MC68HC908GP32CB | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| MC68HC08GR32AMFAE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HC08GR32AMFA | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP48 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC08GP16AVB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GP16AVFB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GP32 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68HC08 Family of 8-bit microcontroller units (MCUs) |
| MC68HC08GP32A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GP32ACB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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