參數(shù)資料
型號(hào)： MC68HC08AZ32AMFU
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： HCMOS Microcontroller Unit
中文描述： 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
封裝： QFP-64
文件頁(yè)數(shù)： 139/456頁(yè)
文件大?。?/td> 3547K
代理商： MC68HC08AZ32AMFU
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Clock Generator Module (CGM)
Acquisition/Lock Time Specifications
MC68HC08AZ32A — Rev 1.0
Technical Data
MOTOROLA
Clock Generator Module (CGM)
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139
step input or when the output settles to the desired value plus or minus
a percent of the frequency change. Therefore, the reaction time is
constant in this definition, regardless of the size of the step input. For
example, consider a system with a 5% acquisition time tolerance. If a
command instructs the system to change from 0 Hz to 1 MHz, the
acquisition time is the time taken for the frequency to reach
1 MHz
±
50 kHz. Fifty kHz = 5% of the 1-MHz step input. If the system is
operating at 1 MHz and suffers a –100 kHz noise hit, the acquisition time
is the time taken to return from 900 kHz to 1 MHz
±
5 kHz. Five kHz = 5%
of the 100-kHz step input.
Other systems refer to acquisition and lock times as the time the system
takes to reduce the error between the actual output and the desired
output to within specified tolerances. Therefore, the acquisition or lock
time varies according to the original error in the output. Minor errors may
not even be registered. Typical PLL applications prefer to use this
definition because the system requires the output frequency to be within
a certain tolerance of the desired frequency regardless of the size of the
initial error.
The discrepancy in these definitions makes it difficult to specify an
acquisition or lock time for a typical PLL. Therefore, the definitions for
acquisition and lock times for this module are:
Acquisition time, t
acq
, is the time the PLL takes to reduce the error
between the actual output frequency and the desired output
frequency to less than the tracking mode entry tolerance,
trk
.
Acquisition time is based on an initial frequency error,
(f
des
– f
orig
)/f
des
, of not more than
±
100%. In automatic bandwidth
control mode (see
Manual and Automatic PLL Bandwidth
Modes
on page 123), acquisition time expires when the ACQ bit
becomes set in the PLL bandwidth control register (PBWC).
Lock time, t
Lock
, is the time the PLL takes to reduce the error
between the actual output frequency and the desired output
frequency to less than the lock mode entry tolerance,
Lock
. Lock
time is based on an initial frequency error, (f
des
– f
orig
)/f
des
, of not
more than
±
100%. In automatic bandwidth control mode, lock time
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
MC68HC08AZ32AVFU HCMOS Microcontroller Unit
MC68HC705C9A Microcontrollers
MC68HC705C9ACB Microcontrollers
MC68HC705C9ACFB Microcontrollers
MC68HC705C9ACFN Microcontrollers
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參數(shù)描述
MC68HC08AZ32AVFU 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers
MC68HC08AZ32CFU 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information
MC68HC08AZ32MFU 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information
MC68HC08AZ32VFU 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information
MC68HC08AZ48 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information
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