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參數(shù)資料
| 型號： | MC68HC05J1AVDW |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | RESISTOR SILICONE 1.5 OHM 5W |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 63/128頁 |
| 文件大?。?/td> | 1620K |
| 代理商： | MC68HC05J1AVDW |
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Parallel Input/Output (I/O)
Port A
MC68HC05J1A — Rev. 3.0
Technical Data
MOTOROLA
Parallel Input/Output (I/O)
For More Information On This Product,
Go to: www.freescale.com
63
7.4.2 Data Direction Register A
The contents of data direction register A (DDRA) determine whether
each port A pin is an input or an output. Writing a logic 1 to a DDRA bit
enables the output buffer for the associated port A pin; a logic 0 disables
the output buffer. A reset initializes all DDRA bits to 0, configuring all port
A pins as inputs.
DDRA7–DDRA0 — Port A Data Direction Bits
These read/write bits control port A data direction.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE:
Avoid glitches on port A pins by writing to the port A data register before
changing DDRA bits from logic 0 to logic 1.
Address:
$0004
Bit 7
6
5
4
3
2
1
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 7-2. Data Direction Register A (DDRA)
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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