參數(shù)資料
型號： MC68EN360FE33
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： RISC MICROCONTROLLER, CQFP240
封裝： CERAMIC, QFP-240
文件頁數(shù)： 496/962頁
文件大?。?/td> 26435K
代理商： MC68EN360FE33
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Serial Communication Controllers (SCCs)
MC68360 USER’S MANUAL
If just one of the TTx or TRx bits is set, the other half of the SCC can operate with another
protocol as programmed in the MODE bits of the GSMR. (This allows loopback modes to
DMA data from one memory location to another while converting the data to a specific serial
format.)
The SCC in transparent mode can work with the TSA or NMSI. The SCC can support
modem lines using the general-purpose I/O pins. The data can be transmitted and received
with MSB or LSB first in each octet.
The SCC in transparent mode consists of separate transmit and receive sections whose
operations are asynchronous with the CPU32+ core and may be either synchronous or
asynchronous with respect to the other SCCs. Each clock can be supplied from the internal
baud rate generator bank, DPLL output, or external pins.
7.10.21.1 TRANSPARENT CONTROLLER FEATURES. The transparent controller con-
tains the following key features:
Flexible Data Buffers
Automatic SYNC Detection on Receive
—16-Bit Pattern
—8-Bit Pattern
—4-Bit Pattern
—External Sync Pin Support
CRCs Can Optionally Be Transmitted and Received
Reverse Data Mode
Another Protocol Can Be Performed on the SCC’s Other Half (Transmitter or Receiver)
During Transparent Mode
MC68302-Compatible Sync Options
7.10.21.2 TRANSPARENT CHANNEL FRAME TRANSMISSION PROCESSING. The
transparent transmitter is designed to work with almost no intervention from the CPU32+
core. When this CPU32+ core enables the SCC transmitter in transparent mode, it will start
transmitting idles. The SCC polls the first BD in the transmit channel’s BD table. When there
is a message to transmit, the SCC will fetch the data from memory, load the transmit FIFO,
and wait for transmitter synchronization before starting to transmit the message.
Transmitter synchronization can be achieved using the CTS pin or waiting for the receiver
to achieve synchronization, depending on the TXSY bit in the GSMR. See 7.10.21.4 Achiev-
ing Synchronization in Transparent Mode for more details. Once transmitter synchronization
is achieved, transmission begins.
When a BD’s data has been completely transmitted, the last in message (L) bit is checked.
If the L-bit is set, the SCC writes the message status bits into the BD and clears the R-bit. It
will then start transmitting idles until the next BD is ready. (Even if the next BD is already
ready, some idles will still be transmitted.) The transmitter will only begin transmission again
after it achieves synchronization.
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Freescale Semiconductor, Inc.
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相關(guān)PDF資料
PDF描述
MC68360RC25 RISC MICROCONTROLLER, CPGA241
MC68EN360RC25 RISC MICROCONTROLLER, CPGA241
MC68360FE25 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240
MC68360CFE25 RISC MICROCONTROLLER, CQFP240
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參數(shù)描述
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MC68EN360RC25L 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EN360RC25V 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
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