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參數(shù)資料
| 型號(hào)： | MC68341FT25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 25.16 MHz, MICROPROCESSOR, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 338/514頁 |
| 文件大?。?/td> | 2891K |
| 代理商： | MC68341FT25 |
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9- 8
MC68341 USER’S MANUAL
MOTOROLA
The system designer must choose a transfer rate (baud) for operation in master mode, an
appropriate clock phase, clock polarity, and the number of bits to be transferred in a serial
operation. Master/slave mode select (MSTR) must be set to configure the QSPI for master
mode or cleared to configure operation in slave mode. WOMQ should be set to enable or
cleared to disable wired-OR mode operation.
SPCR1 (refer to 9.5.4.2 QSPI Control Register (SPCR1))
—SPE must be set to enable the QSPI; this register should be written last.
—DTL allows the user to program a delay after any serial transfer, which is invoked
by the DT bit for any serial transfer.
—DSCKL allows the user to set a delay before SCK (after PCS valid), which is
invoked by the DSCK bit for any transfer.
SPCR2 (refer to 9.5.4.3 QSPI Control Register 2 (SPCR2))
—NEWQP and ENDQP, respectively, determine the beginning of a queue and the
number of serial transfers (up to 16) to be considered a complete queue.
—WREN is set to enable queue wraparound, and WRTO helps determine the
address used in wraparound mode.
—SPIFIE is set to enable interrupts when SPIF is asserted.
SPCR3 (refer to 9.5.4.4 QSPI Control Register 3 (SPCR3))
HALT may be used for program debug, and HMIE is set to enable CPU interrupts
when HALTA or MODF is asserted; LOOPQ is set only to enable a feedback loop that
can be used for self-test mode.
9.4.2 QSPM Global Registers
The QSPM global registers contain system parameters used by the QSPM to interface
with the CPU and other system modules. The four global registers are listed in Table 9-4.
Table 9-4. QSPM Global Registers
Address
Name
Usage
$800
QMCR
QSPM Configuration Register
$802
QTEST
QSPM Test Register
$804
QILR
QSPM Interrupt Level Register
$805
QIVR
QSPM Interrupt Vector Register
9.4.2.1 QSPM CONFIGURATION REGISTER (QMCR). QMCR contains parameters for
interfacing to the CPU and the intermodule bus (IMB). This register can be modified only
when the CPU is in supervisor mode.
F
re
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S
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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c
..
.
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PDF描述 |
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