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參數(shù)資料
| 型號(hào)： | MC68040V |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁(yè)數(shù)： | 191/442頁(yè) |
| 文件大?。?/td> | 2582K |
| 代理商： | MC68040V |
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MOTOROLA
M68040 USER’S MANUAL
7-49
040_BG
AM_BG
040_BB
POSSIBLE
INDETERMINATE
CONDITION
AM_BB
THE 040
ACTIVELY
OWNS THE
BUS HERE
040_LOCK
LOCK IS
VIOLATED
040_TS
040_TA
AM_TS
*
AM indicates the alternate bus master.
*
*
*
Figure 7-31. Lock Violation Example
In addition to the indeterminate condition, the external arbiter’s design needs to include
the function of
BR
. For example, in certain cases associated with conditional branches,
the M68040 can assert
BR
to request the bus from an alternate bus master, then negate
BR
without using the bus, regardless of whether or not the external arbiter eventually
asserts
BG
. This situation happens when the M68040 attempts to prefetch an instruction
for a conditional branch. To achieve maximum performance, the processor prefetches the
instructions of both paths for a conditional branch. If the conditional branch results in a
branch-not-taken, the previously issued branch-taken prefetch is then terminated since the
prefetch is no longer needed. In an attempt to save time, the M68040 negates
BR
. If
BG
takes too long to assert, the M68040 enters a disregard request condition.
The
BR
signal can be reasserted immediately for a different pending bus request, or it can
stay negated indefinitely. If an external bus arbiter is designed to wait for the M68040 to
assert
BB
before proceeding, then the system experiences an extended period of time in
which bus arbitration is locked. Motorola recommends that an external bus arbiter not
assume that there is a direct relationship between
BR
and
BB
or
BR
and
BG
signals.
Figure 7-32 illustrates an example of the processor requesting the bus from the external
bus arbiter. During C1, the M68040 asserts
BR
to request the bus from the arbiter, which
negates the alternate bus master’s
BG
signal and grants the bus to the processor by
asserting
BG
during C3. During C3, the alternate bus master completes its current access
and relinquishes the bus by three-stating all bus signals. Typically, the
BB
and
TIP
signals
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68EC040 | 32-Bit Microprocessors.(32位微處理器) |
| MC68EC040V | 32-Bit Microprocessors.(32位微處理器) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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