LOGIC COMMANDS AND REGISTERS When the mask " />
參數(shù)資料
型號(hào)： MC33889DPEG
廠商： Freescale Semiconductor
文件頁數(shù)： 46/59頁
文件大小： 0K
描述： IC SYSTEM BASE W/CAN 28SOIC
標(biāo)準(zhǔn)包裝： 26
系列： *
Analog Integrated Circuit Device Data
50
Freescale Semiconductor
33889
FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
When the mask bit has been set, INT pin goes low if the appropriate condition occurs.
Notes:
If HS1OT-V2LOW interrupt is only selected (only bit D2 set in INTR register), reading INTR register bit D2 leads to two
possibilities:
Bit D2 = 1: INT source is HS1OT
Bit D2 = 0: INT source is V2LOW.
Upon a wake-up condition from Stop mode due to overcurrent detection (IDD1S-WU1 or IDD1S-WU2), an INT pulse is generated.
However, the INTR register content remains at 0000 (not bit set into the INTR register).
Table 29. Control bits
Control bit
Description
CANF
Mask bit for CAN failures (OR of any CAN failure)
VDDTEMP
Mask bit for VDD medium temperature
HS1OT-V2LOW
Mask bit for HS1 over temperature OR V2 below 4.0 V
VSUPLOW
Mask bit for SUP below 6.1 V
Table 30. Status bits
Status bit
Description
CANF
CAN failure
VDDTEMP
VDD medium temperature
HS1OT
HS1 overtemperature
VSUPLOW
VSUP below 6.1 V, typical
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PDF描述
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