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參數(shù)資料
| 型號(hào)： | MC33389DDW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | System Basis Chip with Low Speed Fault Tolerant CAN |
| 中文描述： | DATACOM, INTERFACE CIRCUIT, PDSO28 |
| 封裝： | PLASTIC, SO-28 |
| 文件頁(yè)數(shù)： | 25/35頁(yè) |
| 文件大?。?/td> | 609K |
| 代理商： | MC33389DDW |
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MC33389
MOTOROLA
25
MC33389
Freescale Semiconductor, Inc.
The SW watchdog is only running in Normal and Standby mode. A reset of this register occurs when RSTB = low
Table 37. GSLR — Ground Shift Level Register
This register is used to monitor the ground shift of the vehicle network.
r
Table 38.
SHIFT
1=ground shift above the threshold selected by GSLR1 and GSLR2. 0=no ground shift
The SHIFT information is latched until a read operation of the GSLR register occurs. The GSLR register is set to 0 after
power on reset. A reset of GSLR1 and GSLR0 occurs when RSTB = low.
TXDOM
0 = no failure on TX
1 = TX permanent dominant
Table 39. WUICR — Wake-up Input Control Register/SPI And Bus Wake-up Status
This register is used to configure the wake up level for the L0, L1 and L2 inputs. in read operation it reports the CAN wake up
and SPI (csb) wake up events
.
0
0
1
Timer on, t2
10
0
1
0
Timer on, t3
20
0
1
1
Timer on, t4
33
1
0
0
Timer on, t5
50
1
0
1
Timer on, t6
75
1
1
0
Timer on, t7
100
1
1
1
Timer on, t8
200
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
GSLR
$00A
R
TXDOM
SHIFT
GSLR1
GSLR0
W
RESET
0
0
0
GSLR1
GSLR0
Typ GND Shift Level
0
0
0.7V
0
1
-1.2V
1
0
-1.7V
1
1
-2.2V
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
WUICR
$00C
R
SPIWU
BUSWU
WUICR1
WUICR0
W
RESET
0
0
0
0
SWCR2
SWCR1
SWCR0
Comments
t(ms) typical
F
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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