參數(shù)資料
型號(hào)： MC10EP31DR2
廠商： ON SEMICONDUCTOR
元件分類： 通用總線功能
英文描述： D Flip Flop with Set and Reset
中文描述： 10E SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO8
封裝： SOIC-8
文件頁數(shù)： 5/8頁
文件大?。?/td> 72K
代理商： MC10EP31DR2
MC10EP31, MC100EP31
http://onsemi.com
5
AC CHARACTERISTICS
V
CC
= 0 V; V
EE
= –3.0 V to –5.5 V or V
CC
= 3.0 V to 5.5 V; V
EE
= 0 V (Note 15.)
–40
°
C
25
°
C
85
°
C
Symbol
Characteristic
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Unit
f
max
Maximum Frequency
(See Figure 2. F
max
/JITTER)
> 3
> 3
> 3
GHz
t
PLH
,
t
PHL
Propagation Delay to
Output Differential
CLK to Q, Q
S, R to Q, Q
250
300
330
380
400
450
270
330
340
400
410
470
300
360
370
430
440
500
ps
t
RR
Set/Reset Recovery
225
225
225
ps
t
S
t
H
Setup Time
Hold Time
100
150
100
150
100
150
ps
t
PW
Minimum Pulse width
SET, RESET
550
450
550
450
550
450
ps
t
JITTER
Cycle–to–Cycle Jitter
(See Figure 2. F
max
/JITTER)
0.2
< 1
0.2
< 1
0.2
< 1
ps
t
r
t
f
Output Rise/Fall Times
(20% – 80%)
Q, Q
50
120
180
60
130
200
70
150
220
ps
15.Measured using a 750 mV source, 50% duty cycle clock source. All loading with 50 ohms to V
CC
–2.0 V.
0
100
200
300
400
500
600
700
800
900
1000
1100
3000
4000
5000
6000
1
2
3
4
5
6
7
8
9
10
11
Figure 2. F
max
/Jitter
FREQUENCY (MHz)
ééééééééé
(JITTER)
V
O
(
O
éé
éé
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PDF描述
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