參數(shù)資料
型號： MC100EP105FAR2
廠商： ON Semiconductor
文件頁數(shù)： 4/11頁
文件大?。?/td> 0K
描述： IC GATE AND/NAND QUAD 2IN 32LQFP
標(biāo)準(zhǔn)包裝： 1
系列： 100EP
邏輯類型： 與/與非門
電路數(shù)： 4
輸入數(shù)： 8 輸入（2，2，2，2）
施密特觸發(fā)器輸入： 無
輸出類型： 差分
電源電壓： 3 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-LQFP（7x7）
包裝： 剪切帶 (CT)
其它名稱： MC100EP105FAROSCT
MC10EP105, MC100EP105
http://onsemi.com
2
NC
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
12345678
24
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21
20
19
18
17
16
MC10EP105
MC100EP105
VEE
D3b
VCC
D3a
D2b
VCC
Q0
VEE
D0a
D0b
VCC
Q3
Q2
Q1
VCC
D2b
D2a
D1b
D1a
D0b D1a
Figure 1. 32Lead LQFP Pinout (Top View)
Q1
Warning: All VCC and VEE pins must be externally connected
to Power Supply to guarantee proper operation.
Table 1. PIN DESCRIPTION
PIN
Dna*, Dnb*, Dna*, Dnb*
Qn, Qn
ECL Data Outputs
FUNCTION
ECL Data Inputs
LL
H
L
H
L
HHL
L
H
L
LH
HH
L
H
L
Table 2. TRUTH TABLE
NC
VCC
Positive Supply
No Connect
VEE
Negative Supply
Figure 2. 32Lead QFN Pinout (Top View)
D0a
D0b
Q0
D1a
D1b
Q1
D2a
D2b
Q2
D3a
D3b
Q3
VEE
* Pins will default LOW when left open.
Dna
Dnb
Dna
Dnb
Qn
Figure 3. Logic Diagram
32
31
30
29
28
27
26
25
9
10
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12
3
4
5
6
7
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20
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18
17
Exposed Pad (EP)
NC
VEE
D3b
VCC
D3a
D2b
VCC
Q0
VEE
D0a
D0b
VCC
Q3
Q2
Q1
VCC Q1
D2b
D2a
D1b
D1a
D0b D1a
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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MC100EP105MNR4G 功能描述:邏輯門 BBG ECL GATE QUAD RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel
MC100EP11 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:3.3V / 5VECL 1:2 Differential Fanout Buffer
MC100EP111 制造商:Motorola Inc 功能描述:
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