參數(shù)資料
型號(hào)： MB91F466BA
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 96 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-144
文件頁(yè)數(shù)： 11/129頁(yè)
文件大?。?/td> 1656K
代理商： MB91F466BA
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European MCU Design Centre
MB91F467BA/466BA/465BA/464BA preliminary datasheet ver. 0.27
Page 108 of 125
Interrupt number
Interuupt level
*1
Interuupt vector
*2
Interrupt
Decimal
Hexa-
decimal
Setting
Register
address
Offset
Default Vector
address
RN
Low Voltage Detection
138
8A
0x1D4
0x000FFDD4
reserved
139
8B
ICR61
0x47D
0x1D0
0x000FFDD0
Time base Overflow
140
8C
0x1CC
0x000FFDCC
PLL Clock Gear
141
8D
ICR62
0x47E
0x1C8
0x000FFDC8
DMA Controller
142
8E
0x1C4
0x000FFDC4
Main/Sub OSC stability wait
143
8F
ICR63
0x47F
0x1C0
0x000FFDC0
Security vector
144
90
-
0x1BC
0x000FFDBC
Used by the INT
instruction.
145
to
255
91
to
FF
-
0x1B8
to
0x000
0x000FFDB8
to
0x000FFC00
Notes:
*1 The ICRs are located in the interrupt controller and set the interrupt level for each interrupt request.
An ICR is provided for each interrupt request.
*2 The vector address for each EIT (exception, interrupt or trap) is calculated by adding the listed offset
to the table base register value (TBR). The TBR specifies the top of the EIT vector table. The
addresses listed in the table are for the default TBR value (0x000FFC00). The TBR is initialized to this
value by a reset. After execution of the internal boot ROM TBR is set to 0x000FFC00.
*3 Used by REALOS
*4 ICR23 and ICR47 can be exchanged by setting the REALOS compatibility bit (addr 0x0C03 : IOS[0])
*5 System reserved
*6 Memory Protection Unit (MPU) support
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PDF描述
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