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參數(shù)資料
| 型號(hào)： | MB90F923NAS |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP120 |
| 封裝： | 16 X 16 MM, 0.50 MM PITCH, PLASTIC, LQFP-120 |
| 文件頁數(shù)： | 47/72頁 |
| 文件大小： | 1066K |
| 代理商： | MB90F923NAS |
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MB90920 Series
51
(4) UART0/1/2/3 (LIN/SCI)
Bit setting: ESCR0/1/2/3:SCES=0, ECCR0/1/2/3:SCDE=0
(VCC
= 5.0 V±10 %, VSS = AVSS = 0.0 V, TA = 40 °C to +105 °C)
Notes :
Depending on the machine clock frequency to be used, the maximum baud rate may be limited by some
parameters. These parameters are shown in “MB90920 series hardware manual”.
CL is the load capacitance connected to the pin during testing.
tCP is the internal operating clock cycle time. Refer to “ (1) Clock timing”.
Parameter
Symbol
Pin name
Conditions
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK0 to SCK3
Internal shift clock
mode output pin
CL
= 80 pF + 1TTL
5 tCP
ns
SCK
↓ → SOT delay time
tSLOVI
SCK0 to SCK3,
SOT0 to SOT3
50
+ 50
ns
Valid SIN
→ SCK ↑
tIVSHI
SCK0 to SCK3,
SIN0 to SIN3
tCP
+ 80
ns
SCK
↑ → valid SIN hold time
tSHIXI
0
ns
Serial clock “L” pulse width
tSLSH
SCK0 to SCK3
External shift clock
mode output pin
CL
= 80 pF + 1TTL
3 tCP
tR
ns
Serial clock “H” pulse width
tSHSL
tCP
+ 10
ns
SCK
↓ → SOT delay time
tSLOVE
SCK0 to SCK3,
SOT0 to SOT3
2 tCP
+ 60
ns
Valid SIN
→ SCK ↑
tIVSHE
SCK0 to SCK3,
SIN0 to SIN3
30
ns
SCK
↑ → valid SIN hold time
tSHIXE
tCP
+ 30
ns
SCK
↓ time
tF
SCK0 to SCK3
10
ns
SCK
↑ time
tR
10
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90F924NAS | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP120 |
| MB90F952MBSPFV | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| MB90F952MBPF | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| MB90F952MBSPF | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| MB90F952MDPF | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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