參數(shù)資料
型號： MAX9380EUA
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 通用總線功能
英文描述： Single-Ended-to-Differential LVECL/LVPECL 2:1 Multiplexer
中文描述： 93 SERIES, 2 LINE TO 1 LINE MULTIPLEXER, COMPLEMENTARY OUTPUT, PDSO8
封裝： MICRO MAX MO-187, PACKAGE-8
文件頁數(shù)： 5/8頁
文件大小： 166K
代理商： MAX9380EUA
M
Single-Ended-to-Differential
LVECL/LVPECL 2:1 Multiplexer
_______________________________________________________________________________________
5
Pin Description
PIN
1
2
3
NAME
NC
Da
Db
FUNCTION
No Connection. Not internally connected.
Single-Ended LVECL/LVPECL Data Input. Da is low default through internal 75k
pulldown resistor.
Single-Ended LVECL/LVPECL Data Input. Db is low default through internal 75k
pulldown resistor.
Single-Ended Control Input. SEL is low default through an internal 75k
pulldown resistor selecting Db.
Setting SEL to high selects Da.
4
SEL
5
6
7
V
EE
Q
Q
Negative Supply Voltage
Differential LVECL/LVPECL Output. Open Emitter.
Q
is default high when inputs are open.
Differential LVECL/LVPECL Output. Open Emitter. Q is default low when inputs are open.
8
V
CC
Positive Supply Voltage. Bypass V
CC
to V
EE
with 0.1μF and 0.01μF capacitors as close to the device as
possible, with the smaller capacitor closest to the IC.
E xp osed
P ad d e
EP
Exposed paddle (MAX9380ESA-EP only). Connect to V
EE
internally. See package dimension.
Figure 1. Data Input-to-Output Propagation Delay and Transition Timing Diagram
Da WHEN SEL = HIGH
OR
Db WHEN SEL = LOW
0 (DIFFERENTIAL)
20%
80%
80%
20%
t
R
t
F
Q
Q
SINGLE-ENDED WAVEFORMS
DIFFERENTIAL WAVEFORM
Q - Q
V
IH
V
IL
50%
50%
t
PLH1
t
PHL1
V
OH
-
V
OL
V
OH
-
V
OL
V
OH
-
V
OL
V
OH
V
OL
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PDF描述
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參數(shù)描述
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