參數(shù)資料
型號(hào)： MAX6649MUA
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 模擬信號(hào)調(diào)理
英文描述： +145∑C Precision SMBus-Compatible Remote/ Local Sensors with Overtemperature Alarms
中文描述： SPECIALTY ANALOG CIRCUIT, PDSO8
封裝： 3 X 3 MM, MO-187CAA, MICRO, SOP-8
文件頁(yè)數(shù)： 3/16頁(yè)
文件大小： 227K
代理商： MAX6649MUA
M
+145°C Precision SMBus-Compatible Remote/
Local Sensors with Overtemperature Alarms
_______________________________________________________________________________________
3
ELECTRICAL CHARACTERISTICS (continued)
(V
CC
= 3.0V to 5.5V, T
A
= -55
°
C to +125
°
C, unless otherwise specified. Typical values are at V
CC
= 3.3V and T
A
= +100
°
C.) (Note 1)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
ALERT
,
OVERT
I
SINK
= 1mA
I
SINK
= 4mA
V
OH
= 5.5V
0.4
0.6
1
Output Low Voltage
V
Output High Leakage Current
SMBus-COMPATIBLE INTERFACE (SCLK AND SDA)
Logic Input Low Voltage
μA
V
IL
0.8
V
V
CC
= 3.0V
V
CC
= 5.5V
V
IN
= GND or V
CC
V
OL
= 0.6V
2.2
2.6
-1
6
Logic Input High Voltage
V
IH
V
Input Leakage Current
Output Low-Sink Current
Input Capacitance
SMBus-COMPATIBLE TIMING
(Note 2)
Serial Clock Frequency
I
LEAK
I
SINK
C
IN
+1
μA
mA
pF
5
f
SCLK
(Note 3)
100
kHz
Bus Free Time Between STOP
and START Condition
t
BUF
4.7
μs
START Condition Setup Time
4.7
μs
Repeat START Condition Setup
Time
t
SU:STA
90% to 90%
50
ns
START Condition Hold Time
STOP Condition Setup Time
Clock Low Period
Clock High Period
Data Setup Time
Receive SCLK/SDA Rise Time
Receive SCLK/SDA Fall Time
Pulse Width of Spike Suppressed
SMBus Timeout
t
HD:STA
t
SU:STO
t
LOW
t
HIGH
t
HD:DAT
t
R
t
F
t
SP
t
TIMEOUT
10% of SDA to 90% of SCLK
90% of SCLK to 90% of SDA
10% to 10%
90% to 90%
(Note 4)
4
4
μs
μs
μs
μs
μs
μs
ns
ns
ms
4.7
4
250
1
300
50
45
0
25
SDA low period for interface reset
37
Note 1:
All parameters tested at a single temperature. Specifications over temperature are guaranteed by design.
Note 2:
Timing specifications guaranteed by design.
Note 3:
The serial interface resets when SCLK is low for more than t
TIMEOUT
.
Note 4:
A transition must internally provide at least a hold time to bridge the undefined region (300ns max) of SCLK
’
s falling edge.
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PDF描述
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參數(shù)描述
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