參數(shù)資料
型號: MAX4926ELT+T
廠商: Maxim Integrated Products
文件頁數(shù): 4/7頁
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描述: IC CTLR OVP W/EXT PFET 6-UDFN
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 2,500
類型: 過壓保護(hù)控制器
應(yīng)用: 手機(jī),數(shù)碼相機(jī),媒體播放器
安裝類型: 表面貼裝
封裝/外殼: 6-WFDFN
供應(yīng)商設(shè)備封裝: 6-uDFN(1.5x1.0)
包裝: 帶卷 (TR)
MAX4923–MAX4926
Overvoltage Protectors with
External pFET
4
_______________________________________________________________________________________
Pin Description
PIN
NAME
FUNCTION
1IN
Voltage Input. IN is both the power-supply input and the overvoltage/undervoltage sense input. Bypass IN to
GND with a 1F ceramic capacitor as close as possible to the device to enable ±15kV (HBM) ESD protection
on IN.
2
GND
Ground
3
FLAG
Fault Indication Open-Drain Output. FLAG deasserts high during undervoltage and overvoltage lockout
conditions. FLAG asserts low during normal operation.
4
GATE
pFET Gate Drive Output. GATE is driven high during a fault condition to turn off the external pFET. When
VUVLO < VIN < VOVLO, GATE is driven low and the external pFET is turned on.
5, 6
N.C.
No Connection. Not internally connected. Leave N.C. unconnected.
MAX4923–MAX4926
GATE DRIVER
GATE
IN
GND
FLAG
CONTROL
LOGIC AND
TIMER
OVLO AND
UVLO
DETECTOR
Functional Diagram
VIN
tDEB
VOVLO
VUVLO
3V
tGON
tFLAG
tGOFF
O.5V
VIN - 0.5V
O.5V
VGATE
VFLAG
Figure 1. Timing Diagram
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PDF描述
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